{"id":6228,"date":"2026-09-06T08:00:00","date_gmt":"2026-09-06T00:00:00","guid":{"rendered":"https:\/\/www.topfastpcb.com\/?p=6228"},"modified":"2026-08-05T16:38:57","modified_gmt":"2026-08-05T08:38:57","slug":"stacked-vs-staggered-microvias-hdi","status":"publish","type":"post","link":"https:\/\/www.topfastpcb.com\/de\/blog\/stacked-vs-staggered-microvias-hdi\/","title":{"rendered":"Gestapelte vs. versetzte Mikrovias: Designregeln und Zuverl\u00e4ssigkeit bei HDI-Leiterplatten (High-Density Interconnect)"},"content":{"rendered":"<p>Da elektronische Ger\u00e4te ihren unaufhaltsamen Weg in Richtung Miniaturisierung und h\u00f6herer Leistung fortsetzen, sind die Layouts von Leiterplatten (PCBs) immer komplexer geworden. Die High-Density-Interconnect-Technologie (HDI) bildet das Fundament der modernen Elektronik und erm\u00f6glicht die Verlegung von Feinraster-Bauteilen wie Ball Grid Arrays (BGAs) und hochintegrierten System-on-Chips (SoCs). Das Herzst\u00fcck der HDI-Leiterplattenfertigung sind Mikrovias \u2013 lasergestanzte L\u00f6cher mit einem Durchmesser von typischerweise 6 mil (150 Mikrometer) oder weniger, die benachbarte oder eng beieinanderliegende Schichten miteinander verbinden. <strong>Erfahren Sie mehr \u00fcber <a href=\"\/de\/blog\/m-sap-technology-pcb\/\">M-SAP-Technologie: Erreichung von Linien- und Zwischenabst\u00e4nden unter 25 Mikrometern f\u00fcr Elektronik der n\u00e4chsten Generation<\/a>.<\/strong><\/p>\n<p>Beim Verlegen von Leiterbahnen in mehrschichtigen HDI-Strukturen m\u00fcssen Ingenieure mehrere dielektrische Schichten durchqueren, um die inneren Verlegungskan\u00e4le zu erreichen. Dies erfordert den Einsatz mehrerer aufeinanderfolgender Mikrovias. Die strukturelle Anordnung dieser aufeinanderfolgenden Mikrovias l\u00e4sst sich in zwei Hauptkategorien einteilen: gestapelte Mikrovias und versetzte Mikrovias. <strong>Erfahren Sie mehr \u00fcber <a href=\"\/de\/blog\/ceramic-pcb-alumina-vs-aln\/\">Keramik-Leiterplatten: Aluminiumoxid vs. Aluminiumnitrid (AlN) \u2013 Keramik-Leiterplatten f\u00fcr extreme Hitze<\/a>.<\/strong><\/p>\n<p>Die Wahl zwischen einer gestapelten und einer versetzten Microvia-Architektur ist nicht nur eine Frage der Verlegungsfreundlichkeit, sondern eine entscheidende technische Entscheidung, die die Herstellbarkeit, die Signalintegrit\u00e4t und die langfristige thermomechanische Zuverl\u00e4ssigkeit des Endprodukts bestimmt. Dieser Artikel befasst sich eingehend mit den technischen Unterschieden zwischen gestapelten und versetzten Microvias und erl\u00e4utert die Designregeln, Zuverl\u00e4ssigkeitsaspekte und fertigungstechnischen \u00dcberlegungen, die f\u00fcr B2B-Entwicklungsteams bei der Entwicklung unternehmenskritischer Hardware von entscheidender Bedeutung sind. <strong>Erfahren Sie mehr \u00fcber <a href=\"\/de\/blog\/sequential-lamination-hdi\/\">Sequentielle Laminierung: Beherrschung des Fertigungsprozesses f\u00fcr HDI-Leiterplatten mit beliebiger Schichtanzahl<\/a>.<\/strong><\/p>\n<div style=\"text-align: center;\"><img loading=\"lazy\" decoding=\"async\" src=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Stacked-vs.-Staggered-Microvias-1.jpg\" alt=\"Gestapelte vs. versetzte Mikrovias\" width=\"600\" height=\"400\" class=\"aligncenter size-full wp-image-6396\" srcset=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Stacked-vs.-Staggered-Microvias-1.jpg 600w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Stacked-vs.-Staggered-Microvias-1-300x200.jpg 300w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Stacked-vs.-Staggered-Microvias-1-18x12.jpg 18w\" sizes=\"auto, (max-width: 600px) 100vw, 600px\" \/><\/div>\n<div id=\"ez-toc-container\" class=\"ez-toc-v2_0_74 counter-hierarchy ez-toc-counter ez-toc-custom ez-toc-container-direction\">\n<div class=\"ez-toc-title-container\">\n<p class=\"ez-toc-title\" style=\"cursor:inherit\">Inhalts\u00fcbersicht<\/p>\n<span class=\"ez-toc-title-toggle\"><\/span><\/div>\n<nav><ul class='ez-toc-list ez-toc-list-level-1' ><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-1\" href=\"https:\/\/www.topfastpcb.com\/de\/blog\/stacked-vs-staggered-microvias-hdi\/#Understanding_Microvia_Architectures_in_HDI\" >Mikrovia-Architekturen in HDI verstehen<\/a><ul class='ez-toc-list-level-3' ><li class='ez-toc-heading-level-3'><a class=\"ez-toc-link ez-toc-heading-2\" href=\"https:\/\/www.topfastpcb.com\/de\/blog\/stacked-vs-staggered-microvias-hdi\/#Stacked_Microvias\" >Gestapelte Mikrovias<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-3'><a class=\"ez-toc-link ez-toc-heading-3\" href=\"https:\/\/www.topfastpcb.com\/de\/blog\/stacked-vs-staggered-microvias-hdi\/#Staggered_Microvias\" >Versetzte Mikrovias<\/a><\/li><\/ul><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-4\" href=\"https:\/\/www.topfastpcb.com\/de\/blog\/stacked-vs-staggered-microvias-hdi\/#Thermomechanical_Reliability_The_Core_Differentiator\" >Thermomechanische Zuverl\u00e4ssigkeit: Das entscheidende Unterscheidungsmerkmal<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-5\" href=\"https:\/\/www.topfastpcb.com\/de\/blog\/stacked-vs-staggered-microvias-hdi\/#Design_Rules_for_Stacked_Microvias\" >Entwurfsregeln f\u00fcr gestapelte Microvias<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-6\" href=\"https:\/\/www.topfastpcb.com\/de\/blog\/stacked-vs-staggered-microvias-hdi\/#Design_Rules_for_Staggered_Microvias\" >Entwurfsregeln f\u00fcr versetzte Microvias<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-7\" href=\"https:\/\/www.topfastpcb.com\/de\/blog\/stacked-vs-staggered-microvias-hdi\/#How_to_Choose_the_Right_Microvia_Structure_Step-by-Step_Guide\" >So w\u00e4hlen Sie die richtige Microvia-Struktur aus (Schritt-f\u00fcr-Schritt-Anleitung)<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-8\" href=\"https:\/\/www.topfastpcb.com\/de\/blog\/stacked-vs-staggered-microvias-hdi\/#Manufacturing_Challenges_and_Cost_Implications\" >Herausforderungen in der Fertigung und Auswirkungen auf die Kosten<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-9\" href=\"https:\/\/www.topfastpcb.com\/de\/blog\/stacked-vs-staggered-microvias-hdi\/#Frequently_Asked_Questions_FAQ\" >H\u00e4ufig gestellte Fragen (FAQ)<\/a><\/li><\/ul><\/nav><\/div>\n<h2><span class=\"ez-toc-section\" id=\"Understanding_Microvia_Architectures_in_HDI\"><\/span>Mikrovia-Architekturen in HDI verstehen<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>Um die Kompromisse bei der Konstruktion nachvollziehen zu k\u00f6nnen, m\u00fcssen zun\u00e4chst die physikalischen Konfigurationen beider Via-Typen im Zusammenhang mit der sequenziellen Laminierung definiert werden \u2013 dem Verfahren, bei dem HDI-Leiterplatten Schicht f\u00fcr Schicht aufgebaut werden. <strong>Erfahren Sie mehr \u00fcber <a href=\"\/de\/blog\/embedded-pcb-components-iot\/\">Eingebettete Komponenten: Miniaturisierung von IoT-Ger\u00e4ten durch eingebettete Leiterplattenkomponenten<\/a>.<\/strong><\/p>\n<h3><span class=\"ez-toc-section\" id=\"Stacked_Microvias\"><\/span>Gestapelte Mikrovias<span class=\"ez-toc-section-end\"><\/span><\/h3>\n<p>Eine gestapelte Microvia-Struktur entsteht, wenn mehrere lasergbohrte Microvias entlang der Z-Achse exakt \u00fcbereinander ausgerichtet sind und drei oder mehr Schichten auf einem geraden vertikalen Weg miteinander verbinden. Beispielsweise befindet sich eine Microvia, die Schicht 1 mit Schicht 2 verbindet, direkt \u00fcber einer Microvia, die Schicht 2 mit Schicht 3 verbindet.<\/p>\n<p>Der Hauptvorteil von gestapelten Microvias liegt in der Platzersparnis. Da sie \u00fcber mehrere Schichten hinweg exakt dieselbe X-Y-Koordinate einnehmen, beanspruchen sie nur ein absolutes Minimum an Leiterplattenfl\u00e4che. Dies macht sie besonders attraktiv f\u00fcr das Routing aus extrem dicht best\u00fcckten Bauteilen wie z. B. BGAs mit 0,4 mm Rasterma\u00df, bei denen die M\u00f6glichkeiten f\u00fcr Ausweichrouten stark eingeschr\u00e4nkt sind. Dar\u00fcber hinaus minimiert eine perfekt vertikale, gestapelte Struktur aus Sicht der Signalintegrit\u00e4t kapazitive Stichleitungen und bietet einen direkten, induktionsarmen Pfad f\u00fcr Hochgeschwindigkeitssignale.<\/p>\n<p>Um jedoch eine mehrschichtige Struktur zu schaffen, muss die darunterliegende Microvia vollst\u00e4ndig mit galvanisch aufgebrachtem Kupfer gef\u00fcllt werden, um eine ebene, massive Oberfl\u00e4che zu schaffen, auf der die nachfolgende Via gebohrt und beschichtet werden kann. Genau bei dieser Konstruktion mit massiven Kupfers\u00e4ulen liegen die Herausforderungen hinsichtlich der Zuverl\u00e4ssigkeit.<\/p>\n<div style=\"text-align: center;\"><img loading=\"lazy\" decoding=\"async\" src=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Stacked-vs.-Staggered-Microvias-1.jpg\" alt=\"Gestapelte vs. versetzte Mikrovias\" width=\"600\" height=\"400\" class=\"aligncenter size-full wp-image-6396\" srcset=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Stacked-vs.-Staggered-Microvias-1.jpg 600w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Stacked-vs.-Staggered-Microvias-1-300x200.jpg 300w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Stacked-vs.-Staggered-Microvias-1-18x12.jpg 18w\" sizes=\"auto, (max-width: 600px) 100vw, 600px\" \/><\/div>\n<h3><span class=\"ez-toc-section\" id=\"Staggered_Microvias\"><\/span>Versetzte Mikrovias<span class=\"ez-toc-section-end\"><\/span><\/h3>\n<p>Bei einer versetzten Microvia-Architektur sind die Microvias, die aufeinanderfolgende Schichten verbinden, in der X-Y-Ebene physisch zueinander versetzt. Beispielsweise landet die Microvia von Schicht 1 nach Schicht 2 auf einem Capture-Pad, und die Microvia von Schicht 2 nach Schicht 3 geht von einer anderen Stelle auf demselben Pad der Schicht 2 (oder einer angeschlossenen Leiterbahn) aus und f\u00fchrt hinunter zur n\u00e4chsten Schicht.<\/p>\n<p>Diese Konfiguration erfordert etwas mehr Platz auf der Leiterplatte, da sich die Anschlussfl\u00e4chen f\u00fcr die aufeinanderfolgenden Durchkontaktierungen nicht perfekt \u00fcberlappen. Dieser geometrische Versatz ver\u00e4ndert jedoch von Natur aus die Spannungsverteilung innerhalb der Leiterplatte w\u00e4hrend thermischer Zyklen. Da die Durchkontaktierungen nicht in einer einzigen vertikalen Spalte angeordnet sind, muss die darunterliegende Durchkontaktierung nicht unbedingt vollst\u00e4ndig mit Kupfer gef\u00fcllt sein (obwohl dies aus anderen verfahrenstechnischen Gr\u00fcnden oft der Fall ist), und die Spannungsvektoren verteilen sich seitlich \u00fcber die Grenzfl\u00e4chen zwischen Dielektrikum und Kupfer, anstatt sich auf einen einzigen Punkt in der Z-Achse der Mehrschichtplatine zu konzentrieren.<\/p>\n<h2><span class=\"ez-toc-section\" id=\"Thermomechanical_Reliability_The_Core_Differentiator\"><\/span>Thermomechanische Zuverl\u00e4ssigkeit: Das entscheidende Unterscheidungsmerkmal<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>Der entscheidende Unterschied zwischen gestapelten und versetzten Mikrovias liegt in ihrer thermomechanischen Zuverl\u00e4ssigkeit, insbesondere bei Reflow-L\u00f6tprozessen mit bleifreiem Lot (bei denen Temperaturen von \u00fcber 250 \u00b0C auftreten k\u00f6nnen) und bei langfristigen thermischen Wechselbelastungen.<\/p>\n<p>Leiterplatten sind Verbundstrukturen, die aus Kupfer und dielektrischen Materialien (wie FR4, Polyimid oder modernen Hochgeschwindigkeitslaminaten) bestehen. Diese Materialien weisen sehr unterschiedliche W\u00e4rmeausdehnungskoeffizienten (CTE) auf. Kupfer dehnt sich um etwa 16\u201318 ppm\/\u00b0C aus, w\u00e4hrend sich das dielektrische Standardmaterial FR4 in der Z-Achse um 50\u201370 ppm\/\u00b0C ausdehnt (oberhalb der Glas\u00fcbergangstemperatur, Tg, erfolgt diese Ausdehnung sogar noch st\u00e4rker).<\/p>\n<p>Wenn eine HDI-Leiterplatte einer Temperaturschwankung ausgesetzt ist, dehnt sich das dielektrische Material in der Z-Achse deutlich st\u00e4rker aus als die Kupferdurchkontaktierungen. Dadurch entsteht eine starke Belastung in der Z-Achse.<\/p>\n<p>Bei gestapelten Mikrovias konzentriert sich diese Spannung vollst\u00e4ndig entlang der einzigen vertikalen Achse der Kupfers\u00e4ule. Das schw\u00e4chste Glied in dieser Struktur ist typischerweise die Grenzfl\u00e4che zwischen dem Zielpad und dem Boden der plattierten Durchkontaktierung, die oft als \u201eZielpad-Trennfl\u00e4che\u201c bezeichnet wird. \u00dcbersteigt die Spannung die Zugfestigkeit dieser Grenzfl\u00e4che zwischen galvanisch und chemisch abgeschiedenem Kupfer, bildet sich ein Mikroriss, der zu einem offenen Stromkreis f\u00fchrt. Die IPC (Association Connecting Electronics Industries) hat zahlreiche Warnungen und Nachtr\u00e4ge herausgegeben, insbesondere in der Norm IPC-6012E, in denen die inh\u00e4renten Zuverl\u00e4ssigkeitsrisiken von gestapelten Mikrovias hervorgehoben werden, insbesondere beim Stapeln von drei oder mehr Schichten (z. B. 3-N-3-HDI-Strukturen).<\/p>\n<p>Umgekehrt entkoppeln versetzte Microvias diese Belastung in der Z-Achse. Da die Vias versetzt angeordnet sind, kann die Ausdehnung des dielektrischen Materials in der Z-Achse nicht auf eine einzelne, durchgehende Kupfers\u00e4ule einwirken. Die Spannung wird \u00fcber die dazwischenliegenden Capture-Pads und das umgebende Dielektrikum abgeleitet. Empirische Daten und HATS-Tests (Highly Accelerated Thermal Shock) belegen durchweg, dass versetzte Mikrovia-Konfigurationen im Vergleich zu ihren gestapelten Gegenst\u00fccken deutlich mehr Temperaturzyklen ohne Ausfall \u00fcberstehen. F\u00fcr Anwendungen mit hohen Zuverl\u00e4ssigkeitsanforderungen \u2013 wie in der Luft- und Raumfahrt, bei ADAS (Advanced Driver Assistance Systems) im Automobilbereich und bei medizinischen Ger\u00e4ten \u2013 werden versetzte Mikrovias mit \u00fcberw\u00e4ltigender Mehrheit bevorzugt.<\/p>\n<h2><span class=\"ez-toc-section\" id=\"Design_Rules_for_Stacked_Microvias\"><\/span>Entwurfsregeln f\u00fcr gestapelte Microvias<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>Wenn die Verdrahtungsdichte den Einsatz von gestapelten Microvias erforderlich macht, m\u00fcssen strenge Designregeln eingehalten werden, um Risiken f\u00fcr die Zuverl\u00e4ssigkeit zu minimieren.<\/p>\n<ul>\n<li><strong>\u00dcber die F\u00fcllung:<\/strong> Bei gestapelten Durchkontaktierungen muss unbedingt eine Kupferbeschichtung von unten nach oben erfolgen, um eine porenfreie, massive Kupferstruktur zu gew\u00e4hrleisten. Etwaige Hohlr\u00e4ume oder Vertiefungen in der darunterliegenden Durchkontaktierung f\u00fchren zu Beschichtungsfehlern und Spannungskonzentrationen in der nachfolgenden gestapelten Durchkontaktierung.<\/li>\n<li><strong>Seitenverh\u00e4ltnis:<\/strong> Das Seitenverh\u00e4ltnis (Dielektrikumdicke zu Bohrlochdurchmesser) jeder einzelnen Mikrovia sollte idealerweise unter 0,8:1 liegen und vorzugsweise n\u00e4her bei 0,5:1. Flachere Vias lassen sich zuverl\u00e4ssiger plattieren und weisen geringere Spannungskonzentrationen auf.<\/li>\n<li><strong>Stapel begrenzen:<\/strong> Vermeiden Sie es, mehr als zwei Microvias \u00fcbereinander anzuordnen (z. B. L1-L2, L2-L3). Die Anordnung von drei oder mehr Microvias erh\u00f6ht die Wahrscheinlichkeit einer Trennung der Zielpads exponentiell.<\/li>\n<li><strong>Dimensionierung von Dichtungen und Ringdichtungen:<\/strong> Achten Sie auf robuste Capture- und Zielpads. Zwar sind bei HDI kleine Pads \u00fcblich, doch eine zu starke Verkleinerung des Zielpads verringert die f\u00fcr die metallurgische Verbindung verf\u00fcgbare Oberfl\u00e4che und schw\u00e4cht dadurch die Via-Struktur.<\/li>\n<li><strong>Auswahl der Materialien:<\/strong> Verwenden Sie dielektrische Materialien mit hoher Tg und geringem CTE. Die Verringerung der Volumenausdehnung des umgebenden Harzsystems ist die wirksamste Methode, um die auf die Kupfer-Via-Struktur wirkende Spannung zu reduzieren.<\/li>\n<\/ul>\n<h2><span class=\"ez-toc-section\" id=\"Design_Rules_for_Staggered_Microvias\"><\/span>Entwurfsregeln f\u00fcr versetzte Microvias<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>Bei der Konstruktion mit versetzten Mikrovias muss die Versatzgeometrie so gesteuert werden, dass die Herstellbarkeit und die elektrische Leistung gew\u00e4hrleistet sind.<\/p>\n<ul>\n<li><strong>Mindestversatz:<\/strong> Das entscheidende Ma\u00df ist der Abstand zwischen dem Mittelpunkt der oberen Via und dem Mittelpunkt der unteren Via. Eine branchen\u00fcbliche Regel besagt, dass der Versatz mindestens dem Durchmesser der Microvia zuz\u00fcglich einer Sicherheitsmarge entsprechen sollte, um ein Ausbrechen zu verhindern.<\/li>\n<li><strong>Tangentiale Anordnung vs. getrennte versetzte Anordnung:<\/strong> Durchkontaktierungen k\u00f6nnen so versetzt angeordnet werden, dass sich ihre Bohrl\u00f6cher tangieren (sich am Rand ber\u00fchren) oder vollst\u00e4ndig voneinander getrennt sind. Vollst\u00e4ndig getrennte Durchkontaktierungen (bei denen sich die Bohrkanten in der Z-Achse nicht \u00fcberlappen) werden aus Gr\u00fcnden der Zuverl\u00e4ssigkeit im Allgemeinen bevorzugt, da sich bei tangierenden Durchkontaktierungen dennoch lokale Spannungskonzentrationen ergeben k\u00f6nnen.<\/li>\n<li><strong>Auswirkungen auf den Routing-Kanal:<\/strong> Entwickler m\u00fcssen die gr\u00f6\u00dfere Gesamtfl\u00e4che einer versetzten Struktur ber\u00fccksichtigen. Dies erfordert eine sorgf\u00e4ltige Fan-Out-Planung unter dicht best\u00fcckten BGAs, um sicherzustellen, dass die versetzten Pads benachbarte Verlegungskan\u00e4le auf den inneren Schichten nicht blockieren.<\/li>\n<li><strong>Zuordnung von Schichtenpaaren:<\/strong> Bei der sequenziellen Laminierung m\u00fcssen bestimmte Schichtpaare gemeinsam verarbeitet werden. Achten Sie bei der Auslegung versetzter Durchkontaktierungen darauf, dass das Versatzmuster mit den vom Hersteller geplanten Laminierungszyklen \u00fcbereinstimmt.<\/li>\n<\/ul>\n<h2><img loading=\"lazy\" decoding=\"async\" src=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Stacked-vs.-Staggered-Microvias-2.jpg\" alt=\"Gestapelte vs. versetzte Mikrovias\" width=\"600\" height=\"400\" class=\"aligncenter size-full wp-image-6397\" srcset=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Stacked-vs.-Staggered-Microvias-2.jpg 600w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Stacked-vs.-Staggered-Microvias-2-300x200.jpg 300w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Stacked-vs.-Staggered-Microvias-2-18x12.jpg 18w\" sizes=\"auto, (max-width: 600px) 100vw, 600px\" \/><\/h2>\n<h2><span class=\"ez-toc-section\" id=\"How_to_Choose_the_Right_Microvia_Structure_Step-by-Step_Guide\"><\/span>So w\u00e4hlen Sie die richtige Microvia-Struktur aus (Schritt-f\u00fcr-Schritt-Anleitung)<span class=\"ez-toc-section-end\"><\/span><\/h2><div class=\"schema-how-to wp-block-yoast-how-to-block\"><p class=\"schema-how-to-description\">Beachten Sie diese technischen Vorschriften.<\/p> <ol class=\"schema-how-to-steps\"><li class=\"schema-how-to-step\" id=\"how-to-step-1\"><strong class=\"schema-how-to-step-name\">Anforderungen an die Routing-Dichte bewerten<\/strong> <p class=\"schema-how-to-step-text\">Beginnen Sie damit, den Pin-Abstand und die Anzahl der Ein- und Ausg\u00e4nge Ihrer komplexesten Bauteile zu analysieren. Stellen Sie fest, ob die extrem hohe Dichte an gestapelten Mikrovias unbedingt erforderlich ist, um die Bauteilgrundfl\u00e4che einzuhalten. Wenn die Verlegung mithilfe versetzter Vias ohne Hinzuf\u00fcgen unn\u00f6tiger Signalschichten realisiert werden kann, sollten versetzte Vias die Standardwahl sein.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-2\"><strong class=\"schema-how-to-step-name\">Das Betriebsumfeld analysieren<\/strong> <p class=\"schema-how-to-step-text\">Bewerten Sie die Anforderungen hinsichtlich der thermischen Zyklen \u00fcber den Lebenszyklus, die extremen Betriebstemperaturbereiche und die erwartete Lebensdauer des Produkts. Bei Anwendungen, die rauen Umgebungsbedingungen, den Bedingungen im Motorraum von Kraftfahrzeugen oder anspruchsvollen Anforderungen in der Luft- und Raumfahrt ausgesetzt sind, muss die thermomechanische Robustheit versetzter Mikrovias Vorrang vor der Platzersparnis gestapelter Architekturen haben.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-3\"><strong class=\"schema-how-to-step-name\">Wenden Sie sich an Ihren Leiterplattenhersteller<\/strong> <p class=\"schema-how-to-step-text\">Bevor Sie sich endg\u00fcltig f\u00fcr einen Laminataufbau entscheiden, sollten Sie sich mit dem von Ihnen ausgew\u00e4hlten Leiterplattenhersteller abstimmen. \u00dcberpr\u00fcfen Sie dessen spezifische F\u00e4higkeiten hinsichtlich der Genauigkeit beim Laserbohren, der sequenziellen Laminierzyklen und der Prozesskontrollen f\u00fcr eine hohlraumfreie Kupferf\u00fcllung. Die bisherige Ausbeute eines Herstellers kann die Entscheidung zwischen gestapelten und versetzten Designs ma\u00dfgeblich beeinflussen.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-4\"><strong class=\"schema-how-to-step-name\">Signalintegrit\u00e4tsanalyse durchf\u00fchren<\/strong> <p class=\"schema-how-to-step-text\">Simulieren Sie die Hochgeschwindigkeits-Signalwege, insbesondere solche mit mehr als 10 Gbit\/s, um sicherzustellen, dass die gew\u00e4hlte Via-Struktur keine inakzeptablen Impedanzspr\u00fcnge verursacht. W\u00e4hrend gestapelte Vias einen etwas k\u00fcrzeren elektrischen Signalweg bieten, lassen sich versetzte Vias oft durch sorgf\u00e4ltiges Pad-Design und Referenzebenenmanagement so optimieren, dass sie strenge Anforderungen an die Signalintegrit\u00e4t erf\u00fcllen.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-5\"><strong class=\"schema-how-to-step-name\">Stackup fertigstellen und Leiterbahnen verlegen<\/strong> <p class=\"schema-how-to-step-text\">Setzen Sie das Design unter Verwendung versetzter Mikrovias als Standardmethode um, um maximale Zuverl\u00e4ssigkeit zu gew\u00e4hrleisten. Setzen Sie gestapelte Mikrovias ausschlie\u00dflich in den spezifischen, lokal begrenzten Bereichen ein, in denen Verlegungsbeschr\u00e4nkungen deren Verwendung zwingend erfordern, und minimieren Sie so das Gesamtrisikoprofil der Leiterplattenbaugruppe.<\/p> <\/li><\/ol><\/div><p>Die Entscheidung zwischen gestapelten und versetzten Konfigurationen erfordert einen systematischen Ansatz, bei dem die elektrischen Anforderungen mit der Herstellbarkeit und der langfristigen Zuverl\u00e4ssigkeit in Einklang gebracht werden m\u00fcssen.<\/p>\n<h2><span class=\"ez-toc-section\" id=\"Manufacturing_Challenges_and_Cost_Implications\"><\/span>Herausforderungen in der Fertigung und Auswirkungen auf die Kosten<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>Die Fertigungsprozesse f\u00fcr HDI-Leiterplatten sind aufgrund der sequenziellen Laminierung von Natur aus komplexer und kostspieliger als bei herk\u00f6mmlichen mehrschichtigen Leiterplatten. Jeder Teilfertigungszyklus umfasst die Belichtung der inneren Schichten, das \u00c4tzen, das Laminieren, das Laserbohren, das Desmear und die Galvanisierung.<\/p>\n<p>Gestapelte Mikrovias treiben die Kosten vor allem aufgrund der speziellen Galvanikchemie und des erh\u00f6hten Zeitaufwands f\u00fcr eine porenfreie Kupferf\u00fcllung in die H\u00f6he. Das Bottom-up-Plattieren ist ein langsamerer Prozess als das herk\u00f6mmliche konforme Plattieren. Wenn zudem die obere Durchkontaktierung in einem Stapel gegen\u00fcber der unteren leicht versetzt ist, kann der Laserbohrer die Kante der darunterliegenden Kupfers\u00e4ule besch\u00e4digen, was zu unmittelbaren Plattierungsfehlern oder latenten Zuverl\u00e4ssigkeitsm\u00e4ngeln f\u00fchrt.<\/p>\n<p>Versetzte Microvias mildern die strenge Anforderung an eine perfekt ebene, durchgehende Kupferf\u00fcllung (auch wenn dies in vielen High-End-Fertigungsanlagen nach wie vor Standard ist). Die gelockerten Toleranzen bei der Z-Achsen-Ausrichtung verbessern die Fertigungsausbeute. Da sie bei thermischer Belastung w\u00e4hrend der Best\u00fcckung (Reflow) weniger anf\u00e4llig f\u00fcr katastrophale Ausf\u00e4lle sind, ist die Gesamt-Ausbeute der best\u00fcckten Leiterplatte oft h\u00f6her, was den geringf\u00fcgigen Verlust an Best\u00fcckungsfl\u00e4che ausgleicht.<\/p>\n<p>Zusammenfassend l\u00e4sst sich sagen: Gestapelte Mikrovias bieten zwar die ultimative L\u00f6sung f\u00fcr extreme Miniaturisierung, erfordern jedoch die strikte Einhaltung von Designvorgaben, hochwertige Materialien und erstklassige Fertigungskapazit\u00e4ten, um thermischen Belastungen standzuhalten. Versetzte Mikrovias stellen eine robustere, fehlertolerantere Architektur dar, die die bevorzugte Wahl f\u00fcr B2B-Konstruktionsentw\u00fcrfe sein sollte, bei denen langfristige Zuverl\u00e4ssigkeit von gr\u00f6\u00dfter Bedeutung ist. <\/p>\n<h2><span class=\"ez-toc-section\" id=\"Frequently_Asked_Questions_FAQ\"><\/span>H\u00e4ufig gestellte Fragen (FAQ)<span class=\"ez-toc-section-end\"><\/span><\/h2><div class=\"schema-faq wp-block-yoast-faq-block\"><div class=\"schema-faq-section\" id=\"faq-question-1\"><strong class=\"schema-faq-question\">Was ist die Hauptursache f\u00fcr Ausf\u00e4lle bei gestapelten Mikrovias?<\/strong> <p class=\"schema-faq-answer\">Die Hauptursache f\u00fcr Ausf\u00e4lle bei gestapelten Mikrovias ist die thermomechanische Erm\u00fcdung, die durch die unterschiedlichen W\u00e4rmeausdehnungskoeffizienten (CTE) der Kupferbeschichtung und des dielektrischen Materials w\u00e4hrend der Temperaturwechselbeanspruchung hervorgerufen wird und zur Abl\u00f6sung der Zielpads oder zu Rissen im Zylinder f\u00fchrt.<\/p> <\/div> <div class=\"schema-faq-section\" id=\"faq-question-2\"><strong class=\"schema-faq-question\">Kann ich auf derselben Leiterplatte gestapelte und versetzte Microvias kombinieren?<\/strong> <p class=\"schema-faq-answer\">Ja, es ist g\u00e4ngige Praxis, beide Architekturen auf einer einzigen High-Density-Interconnect-Leiterplatte (HDI) zu kombinieren. Entwickler verwenden h\u00e4ufig versetzte Mikrovias f\u00fcr den Gro\u00dfteil der Leiterbahnf\u00fchrung, um die Zuverl\u00e4ssigkeit zu maximieren, und reservieren gestapelte Mikrovias ausschlie\u00dflich f\u00fcr Bereiche unter Feinraster-Bauteilen, in denen der Platz f\u00fcr die Leiterbahnf\u00fchrung \u00e4u\u00dferst begrenzt ist.<\/p> <\/div> <div class=\"schema-faq-section\" id=\"faq-question-3\"><strong class=\"schema-faq-question\">Hat die Wahl des dielektrischen Materials Auswirkungen auf die Zuverl\u00e4ssigkeit von Microvias?<\/strong> <p class=\"schema-faq-answer\">Auf jeden Fall. Die Wahl eines dielektrischen Materials mit einer hohen Glas\u00fcbergangstemperatur (Tg) und einem niedrigen W\u00e4rmeausdehnungskoeffizienten (CTE) reduziert die Belastung der Microvia-Strukturen bei Temperaturschwankungen erheblich und verbessert dadurch die allgemeine Zuverl\u00e4ssigkeit der Leiterplatte.<\/p> <\/div> <div class=\"schema-faq-section\" id=\"faq-question-4\"><strong class=\"schema-faq-question\">Sind versetzte Mikrovias in der Herstellung immer kosteng\u00fcnstiger als gestapelte Mikrovias?<\/strong> <p class=\"schema-faq-answer\">Nicht immer, aber oft f\u00fchren sie zu einer besseren Ausbeute. Zwar erfordern beide Verfahren eine sequenzielle Laminierung, doch sind versetzte Mikrovias weniger anf\u00e4llig f\u00fcr mikroskopische Passungsfehler und erfordern nicht zwingend die teure und zeitaufw\u00e4ndige, hohlraumfreie Bottom-up-Kupferbeschichtung, die bei gestapelten Vias notwendig ist. Dies f\u00fchrt in der Regel zu h\u00f6heren Fertigungsausbeuten und geringeren Gesamtkosten durch Ausschuss.<\/p> <\/div> <\/div>","protected":false},"excerpt":{"rendered":"<p>As electronic devices continue their relentless march towards miniaturization and higher performance, printed circuit board (PCB) layouts have become increasingly complex. High-Density Interconnect (HDI) technology is the bedrock of modern electronics, enabling the routing of fine-pitch components like Ball Grid Arrays (BGAs) and highly integrated system-on-chips (SoCs). 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