{"id":6232,"date":"2026-09-07T08:00:00","date_gmt":"2026-09-07T00:00:00","guid":{"rendered":"https:\/\/www.topfastpcb.com\/?p=6232"},"modified":"2026-08-05T17:04:38","modified_gmt":"2026-08-05T09:04:38","slug":"sequential-lamination-hdi","status":"publish","type":"post","link":"https:\/\/www.topfastpcb.com\/de\/blog\/sequential-lamination-hdi\/","title":{"rendered":"Sequentielle Laminierung: Beherrschung des Fertigungsprozesses f\u00fcr HDI-Leiterplatten mit beliebiger Schichtanzahl"},"content":{"rendered":"<div style=\"text-align: center;\"><\/div>\n<p>Die HDI-Technologie (High-Density Interconnect) hat die Welt der Leiterplatten (PCB) grundlegend ver\u00e4ndert und erm\u00f6glicht in der modernen Elektronik eine beispiellose Miniaturisierung, eine verbesserte Signalintegrit\u00e4t sowie eine \u00fcberragende elektrische Leistung. Da Ger\u00e4tearchitekturen \u2013 von hochmodernen Smartphones, 5G-Basisstationen und Wearables bis hin zu fortschrittlichen Computermodulen f\u00fcr die Automobilindustrie und Instrumenten f\u00fcr die Luft- und Raumfahrt \u2013 eine h\u00f6here Pin-Anzahl und Komponenten mit feinerem Rasterabstand erfordern, haben sich herk\u00f6mmliche Leiterplattenherstellungsverfahren als unzureichend erwiesen. Die endg\u00fcltige L\u00f6sung f\u00fcr diese modernen technischen Herausforderungen ist die Umsetzung einer Any-Layer-HDI-Architektur, die durch den strengen und streng kontrollierten Fertigungsprozess der sogenannten sequenziellen Laminierung realisiert wird.<\/p>\n<p>Die sequenzielle Laminierung ist nicht nur ein Fertigungsschritt, sondern eine ausgefeilte technische Methode, die es Entwicklern erm\u00f6glicht, eine Leiterplatte Schicht f\u00fcr Schicht aufzubauen und so komplexe Verbindungsstrukturen zu schaffen, die mit herk\u00f6mmlichen Mehrschicht-Pressverfahren physikalisch nicht realisierbar w\u00e4ren. Im Gegensatz zu herk\u00f6mmlichen Leiterplatten, bei denen alle Schichten in einem einzigen monolithischen Zyklus mit mechanisch gebohrten Durchkontaktierungen gestapelt und gepresst werden, umfasst die sequenzielle Laminierung mehrere iterative Zyklen aus Pressen, Bohren, Galvanisieren und \u00c4tzen. Dieser iterative Prozess ist der entscheidende Schl\u00fcssel zur Herstellung von Mikrovias, Blindvias und vergrabenen Vias, die optimale Leiterbahnverl\u00e4ufe bieten und Signalverluste minimieren. <strong>Erfahren Sie mehr \u00fcber <a href=\"\/de\/blog\/return-path-optimization-si\/\">Optimierung des R\u00fcckpfads: Entwurf solider Referenzebenen f\u00fcr die Signalintegrit\u00e4t bei hohen Frequenzen<\/a>.<\/strong><\/p>\n<p>Im Bereich der Any-Layer-HDI-Leiterplatten (auch bekannt als \u201eEvery Layer Interconnect\u201c oder ELIC) erreicht die sequenzielle Laminierung ihren H\u00f6hepunkt. Bei Any-Layer-HDI-Leiterplatten wird vollst\u00e4ndig auf den herk\u00f6mmlichen starren Kern verzichtet; stattdessen werden gestapelte, mit Kupfer gef\u00fcllte Mikrovias verwendet, um Verbindungen zwischen beliebigen zwei Schichten innerhalb des Schichtaufbaus zu erm\u00f6glichen. Diese architektonische Freiheit reduziert die f\u00fcr komplexe Leiterbahnf\u00fchrung erforderliche Schichtenanzahl drastisch, mindert parasit\u00e4re Kapazit\u00e4ten und Induktivit\u00e4ten durch die Minimierung von Via-Stubs und sorgt f\u00fcr ein hervorragendes W\u00e4rmemanagement. Die Beherrschung des sequenziellen Laminierungsprozesses erfordert jedoch ein tiefgreifendes Verst\u00e4ndnis der Materialwissenschaft, der Photolithografie, der Laserphysik und der Dynamik chemischer Beschichtungsprozesse. <strong>Erfahren Sie mehr \u00fcber <a href=\"\/de\/blog\/conformal-coating-pcba\/\">Konformbeschichtung: Schutz von Leiterplatten vor Feuchtigkeit, Staub und korrosiven Umgebungen<\/a>.<\/strong><\/p>\n<div style=\"text-align: center;\"><img loading=\"lazy\" decoding=\"async\" src=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/HDI-PCB-Sequential-Lamination-1.jpg\" alt=\"Sequentielle Laminierung von HDI-Leiterplatten\" width=\"600\" height=\"400\" class=\"aligncenter size-full wp-image-6401\" srcset=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/HDI-PCB-Sequential-Lamination-1.jpg 600w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/HDI-PCB-Sequential-Lamination-1-300x200.jpg 300w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/HDI-PCB-Sequential-Lamination-1-18x12.jpg 18w\" sizes=\"auto, (max-width: 600px) 100vw, 600px\" \/><\/div>\n<div id=\"ez-toc-container\" class=\"ez-toc-v2_0_74 counter-hierarchy ez-toc-counter ez-toc-custom ez-toc-container-direction\">\n<div class=\"ez-toc-title-container\">\n<p class=\"ez-toc-title\" style=\"cursor:inherit\">Inhalts\u00fcbersicht<\/p>\n<span class=\"ez-toc-title-toggle\"><\/span><\/div>\n<nav><ul class='ez-toc-list ez-toc-list-level-1' ><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-1\" href=\"https:\/\/www.topfastpcb.com\/de\/blog\/sequential-lamination-hdi\/#The_Engineering_Principles_of_Sequential_Lamination\" >Die technischen Grundlagen der sequenziellen Laminierung<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-2\" href=\"https:\/\/www.topfastpcb.com\/de\/blog\/sequential-lamination-hdi\/#How_to_Manufacture_Any-Layer_HDI_Boards_Using_Sequential_Lamination_Step-by-Step_Guide\" >So fertigen Sie HDI-Leiterplatten mit beliebiger Lagenanzahl mittels sequenzieller Laminierung (Schritt-f\u00fcr-Schritt-Anleitung)<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-3\" href=\"https:\/\/www.topfastpcb.com\/de\/blog\/sequential-lamination-hdi\/#Material_Selection_and_Thermal_Considerations\" >Werkstoffauswahl und thermische Aspekte<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-4\" href=\"https:\/\/www.topfastpcb.com\/de\/blog\/sequential-lamination-hdi\/#Challenges_and_Yield_Optimization_Strategies\" >Herausforderungen und Strategien zur Ertragsoptimierung<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-5\" href=\"https:\/\/www.topfastpcb.com\/de\/blog\/sequential-lamination-hdi\/#Frequently_Asked_Questions_FAQ\" >H\u00e4ufig gestellte Fragen (FAQ)<\/a><\/li><\/ul><\/nav><\/div>\n<h2><span class=\"ez-toc-section\" id=\"The_Engineering_Principles_of_Sequential_Lamination\"><\/span>Die technischen Grundlagen der sequenziellen Laminierung<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>Im Kern beruht die sequenzielle Laminierung auf dem pr\u00e4zisen Aufbringen von dielektrischen Materialien und Kupferfolie auf ein Basissubstrat, gefolgt von der Bildung von Mikrovias mittels Laserablation. Der Begriff \u201esequenziell\u201c bezeichnet den sich wiederholenden Charakter dieses Aufbauprozesses. Eine typische Nomenklatur f\u00fcr HDI-Stapelungen ist X-N-X, wobei \u201eN\u201c f\u00fcr die Anzahl der Kernschichten und \u201eX\u201c f\u00fcr die Anzahl der sequenziellen Laminierungszyklen auf jeder Seite des Kerns steht. Beispielsweise umfasst ein 3+4+3-Stapelbau einen 4-lagigen Kern mit drei sequenziellen Aufbaulagen auf der Oberseite und drei auf der Unterseite. Bei Any-Layer-HDI kann die Architektur aus einem rein sequenziellen Aufbau ohne herk\u00f6mmlichen Kern bestehen, was oft einfach durch die Gesamtzahl der Schichten angegeben wird, wie beispielsweise bei einer 10- oder 12-lagigen ELIC-Leiterplatte.<\/p>\n<p>Der Hauptgrund f\u00fcr den Einsatz der sequenziellen Laminierung ist die Herstellung von Mikrovias \u2013 L\u00f6chern mit einem Durchmesser von typischerweise 150 Mikrometern oder weniger. Mit mechanischem Bohren lassen sich Durchkontaktierungen dieser Gr\u00f6\u00dfenordnung grunds\u00e4tzlich nicht zuverl\u00e4ssig herstellen, weshalb der Einsatz von Ultraviolett- (UV) oder Kohlendioxid- (CO\u2082) Lasern erforderlich ist. Der sequenzielle Ansatz stellt sicher, dass diese Laser jeweils nur eine einzige dielektrische Schicht durchdringen m\u00fcssen, was enge Seitenverh\u00e4ltnisse, eine einwandfreie Passgenauigkeit und eine pr\u00e4zise Tiefenkontrolle erm\u00f6glicht. Dar\u00fcber hinaus k\u00f6nnen Hersteller durch das F\u00fcllen dieser Mikrovias mit massivem Kupfer w\u00e4hrend der Galvanisierungsphase die Durchkontaktierungen direkt \u00fcbereinander stapeln \u2013 eine entscheidende Voraussetzung f\u00fcr schicht\u00fcbergreifende Verbindungen, bei denen Signale vertikal durch genau denselben X-Y-Koordinatenpunkt geleitet werden. <strong>Erfahren Sie mehr \u00fcber <a href=\"\/de\/blog\/extreme-thermal-cycling-aerospace-pcb\/\">Extreme Temperaturwechselbeanspruchung: Zuverl\u00e4ssigkeitspr\u00fcfungen und Materialauswahl f\u00fcr Leiterplatten in der Luft- und Raumfahrt<\/a>.<\/strong><\/p>\n<p>Dieser mehrstufige Prozess setzt die Leiterplatte erheblichen mechanischen und thermischen Belastungen aus. Die unterschiedlichen W\u00e4rmeausdehnungskoeffizienten (CTE) zwischen den Kupferschichten (etwa 17 ppm\/\u00b0C), dem dielektrischen Harz und der Glasverst\u00e4rkung k\u00f6nnen bei den hohen Temperaturen in der Laminierpresse oder beim anschlie\u00dfenden Reflow-L\u00f6ten zu Verformungen, Delaminationen oder Rissen in den Durchkontaktierungen f\u00fchren. Daher sind die Auswahl fortschrittlicher Prepreg-Materialien und die pr\u00e4zise Steuerung der Laminierpresszyklen (Temperatur-, Druck- und Vakuumprofile) von entscheidender Bedeutung, um die strukturelle Integrit\u00e4t des Endprodukts zu gew\u00e4hrleisten.<\/p>\n<div style=\"text-align: center;\"><img loading=\"lazy\" decoding=\"async\" src=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/HDI-PCB-Sequential-Lamination-2.jpg\" alt=\"Sequentielle Laminierung von HDI-Leiterplatten\" width=\"600\" height=\"400\" class=\"aligncenter size-full wp-image-6402\" srcset=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/HDI-PCB-Sequential-Lamination-2.jpg 600w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/HDI-PCB-Sequential-Lamination-2-300x200.jpg 300w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/HDI-PCB-Sequential-Lamination-2-18x12.jpg 18w\" sizes=\"auto, (max-width: 600px) 100vw, 600px\" \/><\/div>\n<h2><span class=\"ez-toc-section\" id=\"How_to_Manufacture_Any-Layer_HDI_Boards_Using_Sequential_Lamination_Step-by-Step_Guide\"><\/span>So fertigen Sie HDI-Leiterplatten mit beliebiger Lagenanzahl mittels sequenzieller Laminierung (Schritt-f\u00fcr-Schritt-Anleitung)<span class=\"ez-toc-section-end\"><\/span><\/h2><div class=\"schema-how-to wp-block-yoast-how-to-block\"><p class=\"schema-how-to-description\">Beachten Sie diese technischen Vorschriften. <strong>Erfahren Sie mehr \u00fcber <a href=\"\/de\/blog\/stacked-vs-staggered-microvias-hdi\/\">Gestapelte vs. versetzte Mikrovias: Designregeln und Zuverl\u00e4ssigkeit bei HDI-Leiterplatten (High-Density Interconnect)<\/a>.<\/strong><\/p> <ol class=\"schema-how-to-steps\"><li class=\"schema-how-to-step\" id=\"how-to-step-1\"><strong class=\"schema-how-to-step-name\">Vorbereitung des Kerns und erste Bildgebung<\/strong> <p class=\"schema-how-to-step-text\">Zwar kann bei echtem Any-Layer-HDI mit einem extrem d\u00fcnnen Kern begonnen oder auf einem tempor\u00e4ren Tr\u00e4ger aufgebaut werden, der sp\u00e4ter entfernt wird, doch beginnt die standardm\u00e4\u00dfige sequenzielle Laminierung mit der Vorbereitung eines Innenkerns. Ein kupferkaschiertes Laminat (CCL) wird chemisch gereinigt und mikroge\u00e4tzt, um die Haftung des Fotolacks zu verbessern. Trockenfilm-Fotolack wird auf die Kupferoberfl\u00e4chen laminiert, durch eine hochpr\u00e4zise Fotomaske mit UV-Licht belichtet und entwickelt, um das gew\u00fcnschte Schaltungsmuster freizulegen. Das belichtete Kupfer wird anschlie\u00dfend chemisch wegge\u00e4tzt, wodurch die Leiterbahnen der inneren Schicht zur\u00fcckbleiben. Der Fotolack wird entfernt, und das verbleibende Kupfer wird einer Oxidbehandlung (z. B. mit Braunoxid oder alternativen Oxidformulierungen) unterzogen, um die Oberfl\u00e4chenrauheit zu erh\u00f6hen und eine mikrozahnartige Struktur zu erzeugen, die im nachfolgenden Laminierungsschritt eine maximale Haftfestigkeit gegen\u00fcber dem Dielektrikum gew\u00e4hrleistet.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-2\"><strong class=\"schema-how-to-step-name\">Erster Laminierungszyklus und Pressen<\/strong> <p class=\"schema-how-to-step-text\">Eine Schicht aus ungeh\u00e4rtetem dielektrischem Material (Prepreg), oft in Kombination mit einer Kupferfolie (in einer \u201eFoil-Build\u201c-Konfiguration), wird mithilfe hochpr\u00e4ziser Ausrichtstifte und optischer Ausrichtung exakt \u00fcber dem ge\u00e4tzten Kern positioniert. Diese Baugruppe wird in eine Vakuum-Laminierpresse eingelegt. Unter strengen Vakuumbedingungen, um Lufteinschl\u00fcsse zu vermeiden, wird der Stapel einem sorgf\u00e4ltig abgestimmten W\u00e4rme- und Druckzyklus unterzogen. Das Harz im Prepreg schmilzt (und erreicht dabei seine niedrigste Viskosit\u00e4t), flie\u00dft, um die Schaltkreise der inneren Schicht l\u00fcckenlos zu umschlie\u00dfen, und h\u00e4rtet dann bei steigender Temperatur vollst\u00e4ndig aus und polymerisiert. Das Vakuum ist hierbei entscheidend; etwaige eingeschlossene Hohlr\u00e4ume dehnen sich bei sp\u00e4teren thermischen Prozessen exponentiell aus, was zu katastrophaler Delaminierung f\u00fchren oder als Versagensstellen beim Laserbohren dienen kann.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-3\"><strong class=\"schema-how-to-step-name\">Laserbohren von Mikrovias<\/strong> <p class=\"schema-how-to-step-text\">Sobald der erste Laminierungszyklus abgeschlossen ist, wird die Leiterplatte zur Laserbohrstation weitergeleitet. Bei fortschrittlichen HDI-Leiterplatten kommt h\u00e4ufig eine Kombination aus UV- und CO\u2082-Lasern in einem Dual-Laser-System zum Einsatz. Der UV-Laser dient dazu, die obere Kupferfolie pr\u00e4zise abzutragen (wodurch ein definiertes \u00d6ffnungsfenster entsteht), w\u00e4hrend der CO\u2082-Laser das darunterliegende dielektrische Material bis zum Ziel-Kupferpad auf der darunterliegenden Schicht abtr\u00e4gt. Die Wellenl\u00e4nge des CO\u2082-Lasers wird von Kupfer stark reflektiert, sodass er das Harz abtragen und genau am Ziel-Pad anhalten kann. Die Laserparameter \u2013 darunter Pulsenergie, Frequenz und Fokuspunktgr\u00f6\u00dfe \u2013 m\u00fcssen streng auf das jeweilige dielektrische Material abgestimmt werden, um eine saubere Via-Bildung zu gew\u00e4hrleisten, ohne das Zielpad zu besch\u00e4digen (ein als \u201ePunch-Through\u201c bezeichneter Defekt) oder \u00fcberm\u00e4\u00dfige Harzr\u00fcckst\u00e4nde zu hinterlassen.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-4\"><strong class=\"schema-how-to-step-name\">Entfetten und Metallisierung (Kupferbeschichtung)<\/strong> <p class=\"schema-how-to-step-text\">Die intensive Hitze des Laserabtragungsprozesses schmilzt das dielektrische Harz und hinterl\u00e4sst am Boden der Microvia eine d\u00fcnne Schicht aus verkohltem Harzasche und R\u00fcckst\u00e4nden (Smear), die die elektrische Leitf\u00e4higkeit erheblich beeintr\u00e4chtigen w\u00fcrde. Die Leiterplatten durchlaufen einen intensiven chemischen Desmear-Prozess, bei dem in der Regel alkalische Permanganatl\u00f6sungen bei erh\u00f6hten Temperaturen zum Einsatz kommen, um die Via-W\u00e4nde und das Zielpad gr\u00fcndlich zu reinigen und vorzubereiten. Im Anschluss an die Desmear-Behandlung werden die Leiterplatten einem chemischen Kupferbeschichtungsbad unterzogen, das eine d\u00fcnne, leitf\u00e4hige Keimschicht aus Kupfer auf der gesamten Oberfl\u00e4che abscheidet, einschlie\u00dflich im Inneren der nichtleitenden dielektrischen Durchkontaktierungen. Unmittelbar darauf folgt ein elektrolytischer Kupferbeschichtungsprozess. Bei HDI-Leiterplatten mit beliebiger Schichtenanzahl werden spezielle Beschichtungsadditive (Glanzmittel, Nivelliermittel und Tr\u00e4ger) verwendet, um eine \u201eVia-F\u00fcllung\u201c von unten nach oben zu erreichen, bei der die Mikrovia vollst\u00e4ndig mit Kupfer beschichtet wird, wodurch eine perfekt ebene Oberfl\u00e4che entsteht, die f\u00fcr das Aufbringen der n\u00e4chsten Schicht unerl\u00e4sslich ist.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-5\"><strong class=\"schema-how-to-step-name\">Bildgebung und \u00c4tzen der \u00e4u\u00dferen Schicht<\/strong> <p class=\"schema-how-to-step-text\">Nachdem die Mikrovias vollst\u00e4ndig gef\u00fcllt und die Oberfl\u00e4che auf die gew\u00fcnschte Dicke verkupfert wurde, durchl\u00e4uft die Leiterplatte einen weiteren Fotolithografiezyklus. Fotolack wird aufgetragen, belichtet und entwickelt, um die Schaltkreise f\u00fcr die neu hinzugef\u00fcgte Schicht zu definieren, einschlie\u00dflich der kritischen Anschlusspads, die die darunterliegenden gestapelten Durchkontaktierungen \u00fcberlagern. Das unerw\u00fcnschte Kupfer wird wegge\u00e4tzt und der Fotolack entfernt, wodurch das Leiterbild f\u00fcr diese spezifische Schicht fertiggestellt wird.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-6\"><strong class=\"schema-how-to-step-name\">Nachfolgende Laminierungszyklen (das \u201esequenzielle\u201c Verfahren)<\/strong> <p class=\"schema-how-to-step-text\">Die Schritte 2 bis 5 bilden einen einzigen aufeinanderfolgenden Aufbauzyklus. Bei einer HDI-Leiterplatte, die mehrere aufeinanderfolgende Schichten erfordert, oder bei einer ELIC-Leiterplatte mit beliebiger Schichtenanzahl wird diese gesamte Abfolge f\u00fcr jede weitere Schicht sorgf\u00e4ltig wiederholt. Eine neue Lage Prepreg und Kupferfolie wird laminiert, neue Microvias werden per Laser gebohrt (oft direkt auf die mit massivem Kupfer gef\u00fcllten Durchkontaktierungen der vorherigen Schicht gestapelt), von R\u00fcckst\u00e4nden befreit, massiv beschichtet, belichtet und ge\u00e4tzt. Dieser iterative Zyklus erfordert au\u00dfergew\u00f6hnliche Passgenauigkeit, da die Ausrichtungs-Toleranzen mit jeder hinzugef\u00fcgten Schicht aufgrund kumulativer Materialverschiebungen und Skalierungsfaktoren immer strenger werden.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-7\"><strong class=\"schema-how-to-step-name\">Endbearbeitung und Qualit\u00e4tskontrolle<\/strong> <p class=\"schema-how-to-step-text\">Nachdem alle sequenziellen Schichten aufgebaut und die Schaltkreise der \u00e4u\u00dferen Endschicht definiert wurden, durchl\u00e4uft die Leiterplatte die \u00fcblichen abschlie\u00dfenden Fertigungsschritte. Dazu geh\u00f6rt das Aufbringen einer fl\u00fcssigen, lichtempfindlichen L\u00f6tmaske (LPI), die pr\u00e4zise auf die hochdichten Pads und die BGA-Footprints mit engem Rasterabstand ausgerichtet werden muss. Anschlie\u00dfend wird eine Oberfl\u00e4chenbeschichtung (z. B. ENIG, ENEPIG oder Immersionsverzinnung) aufgebracht, um das freiliegende Kupfer zu sch\u00fctzen und die L\u00f6tbarkeit sicherzustellen. Angesichts der enormen Komplexit\u00e4t und des hohen Werts von sequenziell laminierten Leiterplatten sind strenge Pr\u00fcfverfahren unerl\u00e4sslich. Die automatisierte optische Inspektion (AOI) pr\u00fcft jede Schicht auf Leiterbahnfehler, w\u00e4hrend zur Impedanzpr\u00fcfung die Zeitbereichsreflektometrie (TDR) zum Einsatz kommen kann. Entscheidend ist, dass durch elektrische Hochspannungspr\u00fcfungen der unbest\u00fcckten Leiterplatte sichergestellt wird, dass innerhalb der unglaublich dichten Via-Strukturen keine Mikrokurzschl\u00fcsse oder Unterbrechungen vorliegen.<\/p> <\/li><\/ol><\/div><p><img loading=\"lazy\" decoding=\"async\" src=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/HDI-PCB-Sequential-Lamination.jpg\" alt=\"Sequentielle Laminierung von HDI-Leiterplatten\" width=\"600\" height=\"400\" class=\"aligncenter size-full wp-image-6400\" srcset=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/HDI-PCB-Sequential-Lamination.jpg 600w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/HDI-PCB-Sequential-Lamination-300x200.jpg 300w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/HDI-PCB-Sequential-Lamination-18x12.jpg 18w\" sizes=\"auto, (max-width: 600px) 100vw, 600px\" \/><\/p>\n<h2><span class=\"ez-toc-section\" id=\"Material_Selection_and_Thermal_Considerations\"><\/span>Werkstoffauswahl und thermische Aspekte<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>Der Erfolg der sequenziellen Laminierung h\u00e4ngt in hohem Ma\u00dfe von der Wahl der Materialien ab. Standard-FR-4 ist f\u00fcr fortschrittliche HDI-Anwendungen aufgrund seines relativ hohen CTE oft ungeeignet, da dies bei Temperaturwechselbeanspruchungen zu schweren Spannungsrissen in gestapelten Microvias oder zum Abl\u00f6sen der L\u00f6tpads f\u00fchren kann. Ingenieure m\u00fcssen Harzsysteme mit hoher Tg (Glas\u00fcbergangstemperatur, typischerweise &gt;170 \u00b0C) und niedrigem CTE spezifizieren, um die Zuverl\u00e4ssigkeit zu gew\u00e4hrleisten.<\/p>\n<p>Dar\u00fcber hinaus spielt die Art des Glasgewebes des Prepregs eine wesentliche Rolle. Herk\u00f6mmliche grobe Glasgewebe k\u00f6nnen eine Laserablenkung verursachen (den sogenannten \u201eGlaskn\u00f6chel\u201c-Effekt) und zu ungleichm\u00e4\u00dfigen Laserbohrungen, schr\u00e4gen Durchkontaktierungen oder unvollst\u00e4ndiger Ablation f\u00fchren. Um dem entgegenzuwirken, werden h\u00e4ufig laserbohrbare Prepregs eingesetzt, die auf der Spread-Glass-Technologie basieren, oder sogar unverst\u00e4rkte, harzbeschichtete Kupferfolien (RCC). RCC ist besonders wertvoll bei Any-Layer-HDI, da es eine gleichm\u00e4\u00dfige dielektrische Dicke bietet und das Glasgewebe vollst\u00e4ndig eliminiert. Dadurch werden konsistente Durchkontaktierungsgeometrien gew\u00e4hrleistet und die Signalintegrit\u00e4t drastisch verbessert, indem lokale Schwankungen der Dielektrizit\u00e4tskonstante reduziert und der Glasgewebe-Effekt (Schr\u00e4glage) bei Hochgeschwindigkeits-Differenzpaaren beseitigt werden.<\/p>\n<p>Das W\u00e4rmemanagement ist ein weiterer entscheidender Faktor. Zwar bieten gestapelte Mikrovias im Vergleich zu Standard-FR-4 eine hervorragende W\u00e4rmeleitf\u00e4higkeit (sie wirken im Wesentlichen als thermische Durchkontaktierungen), doch erzeugt die extreme Bauteildichte auf HDI-Leiterplatten mit beliebigen Schichten erhebliche lokale W\u00e4rmeentwicklung. Bei der thermischen Modellierung w\u00e4hrend der Entwurfsphase muss der spezifische W\u00e4rmewiderstand des sequenziellen Schichtaufbaus ber\u00fccksichtigt werden. Die Auswahl dielektrischer Materialien mit h\u00f6herer W\u00e4rmeleitf\u00e4higkeit kann lokale Hotspots mindern und die langfristige Zuverl\u00e4ssigkeit in rauen Betriebsumgebungen gew\u00e4hrleisten, wodurch ein thermischer Durchbruch in integrierten Schaltkreisen mit hoher Leistung verhindert wird.<\/p>\n<h2><span class=\"ez-toc-section\" id=\"Challenges_and_Yield_Optimization_Strategies\"><\/span>Herausforderungen und Strategien zur Ertragsoptimierung<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>Die sequenzielle Laminierung ist von Natur aus teurer, zeitaufwendiger und anspruchsvoller als das herk\u00f6mmliche Mehrschichtpressverfahren. Die gr\u00f6\u00dfte Herausforderung ist der Ertragsverlust: Da es sich um einen iterativen Prozess handelt, f\u00fchrt ein Fehler im letzten Laminierungszyklus dazu, dass die gesamte Leiterplatte als Ausschuss gilt, wodurch der gesamte bisherige Bearbeitungsaufwand, die investierte Zeit und die hochwertigen Materialien verschwendet werden.<\/p>\n<p>Die Skalierung bei der Registrierung ist ein st\u00e4ndiger und anspruchsvoller Kampf. Da die Platte w\u00e4hrend jeder Laminierphase wiederholten Zyklen hoher Hitze und hohem Druck ausgesetzt ist, dehnen sich die Materialien aus, ziehen sich zusammen und verformen sich dauerhaft, wodurch sich die Ma\u00dfhaltigkeit der Platte ver\u00e4ndert. Hersteller m\u00fcssen fortschrittliche, vorausschauende Skalierungssoftware einsetzen, die Verformungen und die Eigenschaften des F\u00fcllmaterials ber\u00fccksichtigt, sowie hochpr\u00e4zise CCD-Kamera-Ausrichtungssysteme bei jedem Bildgebungs- und Bohrschritt, um diese Materialbewegungen dynamisch auszugleichen.<\/p>\n<p>Dar\u00fcber hinaus muss die chemische Steuerung der Galvanikb\u00e4der zur Via-F\u00fcllung au\u00dferordentlich pr\u00e4zise sein. Die Str\u00f6mungsverh\u00e4ltnisse innerhalb einer 100-Mikrometer-Blindvia sind komplex. Die Galvanikchemie muss Kupfer pr\u00e4zise von unten nach oben abscheiden, ohne oben Br\u00fccken zu bilden und Chemikalien im Inneren einzuschlie\u00dfen. Die Gew\u00e4hrleistung einer porenfreien Kupferabscheidung in den gestapelten Durchkontaktierungen ist von entscheidender Bedeutung, da jede eingeschlossene Porenbildung w\u00e4hrend der Reflow-Prozesse bei der Hochtemperatur-Best\u00fcckung zu heftiger Ausgasung und zum Versagen der Durchkontaktierungsh\u00fclsen (Blasenbildung) f\u00fchren kann. Zur Aufrechterhaltung einer maximalen Ausbeute ist eine kontinuierliche \u00dcberwachung der Konzentrationen in den Galvanikb\u00e4dern, der organischen Additive und der Stromdichteprofile erforderlich.<\/p>\n<p>Die Herstellung von HDI-Leiterplatten mit beliebig vielen Schichten mittels sequenzieller Laminierung ist ein komplexer, streng kontrollierter Arbeitsablauf. Jeder Arbeitsschritt muss fehlerfrei ausgef\u00fchrt werden, um Kettenfehler zu vermeiden. In diesem Abschnitt werden die grundlegenden Schritte zum Aufbau der Verbindungsstrukturen n\u00e4her erl\u00e4utert.<\/p>\n<h2><span class=\"ez-toc-section\" id=\"Frequently_Asked_Questions_FAQ\"><\/span>H\u00e4ufig gestellte Fragen (FAQ)<span class=\"ez-toc-section-end\"><\/span><\/h2><div class=\"schema-faq wp-block-yoast-faq-block\"><div class=\"schema-faq-section\" id=\"faq-question-1\"><strong class=\"schema-faq-question\">Was ist der Unterschied zwischen einer herk\u00f6mmlichen Blind-Via und einer gestapelten Microvia bei der sequenziellen Laminierung?<\/strong> <p class=\"schema-faq-answer\">Eine Standard-Blind-Via verbindet die \u00e4u\u00dfere Schicht mit einer inneren Schicht und wird in der Regel durch Bohren durch eine einzelne dielektrische Schicht hergestellt. Eine gestapelte Microvia, die nur durch sequenzielles Laminieren und hochspezialisierte Bottom-up-Via-F\u00fcllung mittels Kupferbeschichtung realisierbar ist, beinhaltet das Anordnen mehrerer Microvias direkt \u00fcbereinander \u00fcber aufeinanderfolgende Schichten hinweg. Dies ist f\u00fcr HDI-Leiterplatten mit beliebiger Schichtenanzahl unerl\u00e4sslich, da es eine vertikale Verbindung direkt durch die Leiterplatte erm\u00f6glicht, ohne dass die Durchkontaktierungen versetzt angeordnet werden m\u00fcssen. Dadurch wird wertvoller Platz f\u00fcr die Leiterbahnf\u00fchrung eingespart und die Signalintegrit\u00e4t bei hohen Frequenzen verbessert.<\/p> <\/div> <div class=\"schema-faq-section\" id=\"faq-question-2\"><strong class=\"schema-faq-question\">Warum werden bei der sequenziellen Laminierung f\u00fcr HDI keine herk\u00f6mmlichen mechanischen Bohrer verwendet?<\/strong> <p class=\"schema-faq-answer\">Mechanische Bohrer werden bei Durchmessern unter 150 Mikrometern \u00e4u\u00dferst spr\u00f6de und wirtschaftlich unrentabel. Zudem l\u00e4sst sich beim mechanischen Bohren die Tiefe (Z-Achse) nicht zuverl\u00e4ssig steuern, um pr\u00e4zise auf einem Ziel-Kupferpad anzuhalten, das sich nur wenige Mikrometer unter der Oberfl\u00e4che befindet, ohne dabei Sch\u00e4den zu verursachen. Das Laserbohren bietet die erforderliche ber\u00fchrungslose Pr\u00e4zision, die exakte Steuerung der Abtragstiefe und die im Mikrometerbereich liegenden Durchmesser, die f\u00fcr die zuverl\u00e4ssige Herstellung von HDI-Mikrovias in gro\u00dfem Ma\u00dfstab erforderlich sind.<\/p> <\/div> <div class=\"schema-faq-section\" id=\"faq-question-3\"><strong class=\"schema-faq-question\">Wie wirkt sich die sequenzielle Laminierung auf die gesamte Fertigungsdurchlaufzeit einer Leiterplatte aus?<\/strong> <p class=\"schema-faq-answer\">Die sequenzielle Laminierung verl\u00e4ngert die Fertigungsvorlaufzeit erheblich. Eine standardm\u00e4\u00dfige Mehrschichtplatine erfordert lediglich einen Prim\u00e4rzyklus in der Laminierpresse sowie einen Hauptzyklus f\u00fcr Bohren und Galvanisieren. Im Gegensatz dazu erfordert eine sequenzielle Platine f\u00fcr *jede* hinzugef\u00fcgte sequenzielle Schicht einen vollst\u00e4ndigen Zyklus aus Pressen, Laserbohren, Desmear, Galvanisieren und \u00c4tzen. Daher erfordert eine HDI-Leiterplatte mit einem 3+4+3-Schichtaufbau erheblich mehr Fertigungszeit und Arbeitsaufwand als eine standardm\u00e4\u00dfige 10-lagige Leiterplatte.<\/p> <\/div> <div class=\"schema-faq-section\" id=\"faq-question-4\"><strong class=\"schema-faq-question\">Wird die sequenzielle Laminierung nur bei starren Leiterplatten angewendet?<\/strong> <p class=\"schema-faq-answer\">Nein, Prinzipien der sequenziellen Laminierung finden auch bei starr-flexiblen und rein flexiblen Leiterplatten breite Anwendung. Flexible Leiterplatten mit hoher Dichte erfordern oft Mikrovias und komplexe Leiterbahnf\u00fchrung, bei denen sequenzielle Schichtaufbautechniken von Vorteil sind. Bei diesen Anwendungen kommen spezielle flexible Dielektrika wie Polyimid anstelle von starren FR-4-Prepregs zum Einsatz, was hochspezialisierte Handhabungs- und Verarbeitungsparameter erfordert, die auf flexible Materialien abgestimmt sind.<\/p> <\/div> <div class=\"schema-faq-section\" id=\"faq-question-5\"><strong class=\"schema-faq-question\">Wof\u00fcr steht \u201eELIC\u201c und in welchem Zusammenhang steht es mit der sequenziellen Laminierung?<\/strong> <p class=\"schema-faq-answer\">ELIC steht f\u00fcr \u201eEvery Layer Interconnect\u201c. Es handelt sich um eine spezielle, hochmoderne Art der HDI-Leiterplattenarchitektur, bei der jede Schicht nacheinander aufgebaut wird, in der Regel ohne einen dicken, starren Kern in der Mitte. Das Verfahren basiert vollst\u00e4ndig auf gestapelten, vollst\u00e4ndig mit Kupfer gef\u00fcllten Mikrovias, die eine elektrische Verbindung zwischen beliebigen zwei Schichten im gesamten Stapel erm\u00f6glichen. ELIC stellt die komplexeste und leistungsf\u00e4higste Anwendung des sequenziellen Laminierungsverfahrens dar und wird h\u00e4ufig in Premium-Smartphones und ultrakompakten Ger\u00e4ten eingesetzt.<\/p> <\/div> <\/div>","protected":false},"excerpt":{"rendered":"<p>Die HDI-Technologie (High-Density Interconnect) hat die Welt der Leiterplatten (PCB) grundlegend ver\u00e4ndert und erm\u00f6glicht in der modernen Elektronik eine beispiellose Miniaturisierung, verbesserte Signalintegrit\u00e4t und \u00fcberragende elektrische Leistung. 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