{"id":6207,"date":"2026-08-23T08:00:00","date_gmt":"2026-08-23T00:00:00","guid":{"rendered":"https:\/\/www.topfastpcb.com\/?p=6207"},"modified":"2026-08-04T22:10:55","modified_gmt":"2026-08-04T14:10:55","slug":"ic-substrates-pcb-manufacturing","status":"publish","type":"post","link":"https:\/\/www.topfastpcb.com\/es\/blog\/ic-substrates-pcb-manufacturing\/","title":{"rendered":"Sustratos para circuitos integrados: La evoluci\u00f3n de la fabricaci\u00f3n de placas de circuito impreso: Introducci\u00f3n a los sustratos para circuitos integrados"},"content":{"rendered":"<div id=\"ez-toc-container\" class=\"ez-toc-v2_0_74 counter-hierarchy ez-toc-counter ez-toc-custom ez-toc-container-direction\">\n<div class=\"ez-toc-title-container\">\n<p class=\"ez-toc-title\" style=\"cursor:inherit\">Tabla de contenidos<\/p>\n<span class=\"ez-toc-title-toggle\"><\/span><\/div>\n<nav><ul class='ez-toc-list ez-toc-list-level-1' ><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-1\" href=\"https:\/\/www.topfastpcb.com\/es\/blog\/ic-substrates-pcb-manufacturing\/#Introduction_to_IC_Substrates\" >Introducci\u00f3n a los sustratos para circuitos integrados<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-2\" href=\"https:\/\/www.topfastpcb.com\/es\/blog\/ic-substrates-pcb-manufacturing\/#The_Evolution_of_PCB_Manufacturing\" >La evoluci\u00f3n de la fabricaci\u00f3n de placas de circuito impreso<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-3\" href=\"https:\/\/www.topfastpcb.com\/es\/blog\/ic-substrates-pcb-manufacturing\/#Key_Differences_Between_Standard_PCBs_and_IC_Substrates\" >Diferencias clave entre las placas de circuito impreso est\u00e1ndar y los sustratos para circuitos integrados<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-4\" href=\"https:\/\/www.topfastpcb.com\/es\/blog\/ic-substrates-pcb-manufacturing\/#Core_Materials_in_IC_Substrate_Manufacturing\" >Materiales b\u00e1sicos en la fabricaci\u00f3n de sustratos para circuitos integrados<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-5\" href=\"https:\/\/www.topfastpcb.com\/es\/blog\/ic-substrates-pcb-manufacturing\/#Types_of_IC_Substrates\" >Tipos de sustratos para circuitos integrados<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-6\" href=\"https:\/\/www.topfastpcb.com\/es\/blog\/ic-substrates-pcb-manufacturing\/#How_to_Manufacture_IC_Substrates_Step-by-Step_Guide\" >C\u00f3mo fabricar sustratos para circuitos integrados (gu\u00eda paso a paso)<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-7\" href=\"https:\/\/www.topfastpcb.com\/es\/blog\/ic-substrates-pcb-manufacturing\/#The_Role_of_mSAP_Modified_Semi-Additive_Process\" >El papel del mSAP (proceso semiaditivo modificado)<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-8\" href=\"https:\/\/www.topfastpcb.com\/es\/blog\/ic-substrates-pcb-manufacturing\/#Advanced_Packaging_and_the_Future_of_IC_Substrates\" >El encapsulado avanzado y el futuro de los sustratos para circuitos integrados<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-9\" href=\"https:\/\/www.topfastpcb.com\/es\/blog\/ic-substrates-pcb-manufacturing\/#Frequently_Asked_Questions_FAQ\" >Preguntas Frecuentes (FAQ)<\/a><\/li><\/ul><\/nav><\/div>\n<h2><span class=\"ez-toc-section\" id=\"Introduction_to_IC_Substrates\"><\/span>Introducci\u00f3n a los sustratos para circuitos integrados<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>En el \u00e1mbito altamente especializado de la fabricaci\u00f3n de semiconductores y el montaje electr\u00f3nico, el sustrato de circuitos integrados (IC) act\u00faa como interfaz electroqu\u00edmica y termomec\u00e1nica fundamental entre un chip de silicio sin encapsular y la placa de circuito impreso (PCB) principal. A medida que la tecnolog\u00eda de semiconductores se reduce a nodos de un solo d\u00edgito en nan\u00f3metros, la discrepancia de escala entre las almohadillas de E\/S microsc\u00f3picas de un chip de silicio y las pistas macrosc\u00f3picas de una placa base est\u00e1ndar ha crecido exponencialmente. El sustrato del CI existe precisamente para salvar esta brecha dimensional.<\/p>\n<p>Un sustrato de circuito integrado es, en esencia, una placa de circuito impreso ultraminiaturizada y muy avanzada. Act\u00faa como soporte fundamental dentro de un encapsulado de circuito integrado, canalizando la alimentaci\u00f3n y las se\u00f1ales hacia y desde el chip, proporcionando estabilidad mec\u00e1nica y disipando la energ\u00eda t\u00e9rmica generada por el silicio de alto rendimiento. Sin la evoluci\u00f3n continua de los sustratos de circuitos integrados, los paradigmas inform\u00e1ticos modernos \u2014desde cl\u00fasteres de computaci\u00f3n de alto rendimiento (HPC) y aceleradores de inteligencia artificial (IA) hasta procesadores m\u00f3viles 5G\u2014 ser\u00edan totalmente inviables. Este art\u00edculo profundiza en la evoluci\u00f3n t\u00e9cnica de la fabricaci\u00f3n de placas de circuito impreso (PCB) que ha dado lugar al sustrato de circuitos integrados moderno, analizando sus materiales, sus complejos procesos de fabricaci\u00f3n y su papel indispensable en el futuro del encapsulado heterog\u00e9neo avanzado.<\/p>\n<h2><span class=\"ez-toc-section\" id=\"The_Evolution_of_PCB_Manufacturing\"><\/span>La evoluci\u00f3n de la fabricaci\u00f3n de placas de circuito impreso<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>La evoluci\u00f3n de la fabricaci\u00f3n de placas de circuito impreso ha estado marcada por una miniaturizaci\u00f3n continua, impulsada sin tregua por las exigencias de la Ley de Moore y la necesidad de una mayor densidad de interconexiones. Inicialmente, los conjuntos electr\u00f3nicos se basaban en la tecnolog\u00eda de orificios pasantes (THT), en la que los componentes con cables largos se insertaban en orificios perforados en la placa. A medida que los circuitos integrados se volvieron m\u00e1s complejos, la tecnolog\u00eda THT dio paso a la tecnolog\u00eda de montaje en superficie (SMT). La SMT permiti\u00f3 soldar los componentes directamente sobre la superficie de la placa, lo que redujo significativamente la inductancia par\u00e1sita y aument\u00f3 la densidad de los componentes al eliminar la necesidad de grandes orificios pasantes.<\/p>\n<div style=\"text-align: center;\"><img loading=\"lazy\" decoding=\"async\" alt=\"Sustratos para circuitos integrados\" class=\"aligncenter size-full wp-image-6335\" height=\"378\" src=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/IC-Substrates-1.jpg\" width=\"600\" srcset=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/IC-Substrates-1.jpg 600w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/IC-Substrates-1-300x189.jpg 300w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/IC-Substrates-1-18x12.jpg 18w\" sizes=\"auto, (max-width: 600px) 100vw, 600px\" \/><\/div>\n<p>Sin embargo, a medida que el n\u00famero de pines se dispar\u00f3 con la llegada de los microprocesadores complejos, las placas de circuito impreso SMT est\u00e1ndar ya no pod\u00edan alojar la densidad de se\u00f1ales necesaria. Esta limitaci\u00f3n hizo necesario el desarrollo de placas de circuito impreso de interconexi\u00f3n de alta densidad (HDI). La tecnolog\u00eda HDI introdujo microv\u00edas perforadas con l\u00e1ser, v\u00edas ciegas y v\u00edas enterradas, junto con anchos de l\u00ednea y espacios (L\/S) mucho m\u00e1s finos.<\/p>\n<p>La transici\u00f3n del empalme perif\u00e9rico de cables al encapsulado \u00abflip-chip\u00bb en matriz fue el catalizador definitivo para el sustrato moderno de circuitos integrados. En una configuraci\u00f3n \u00abflip-chip\u00bb, el chip de silicio se invierte y sus almohadillas de E\/S superficiales se conectan directamente al sustrato mediante protuberancias de soldadura microsc\u00f3picas. Este enfoque redujo dr\u00e1sticamente la longitud de las rutas de se\u00f1al y mejor\u00f3 las redes de suministro de energ\u00eda (PDN), pero requiri\u00f3 una placa portadora con densidades de pistas que superaban con creces lo que pod\u00eda lograr la fabricaci\u00f3n tradicional de placas de circuito impreso HDI. As\u00ed, el sustrato de circuitos integrados surgi\u00f3 como una disciplina especializada, que combina fundamentalmente t\u00e9cnicas de fabricaci\u00f3n a nivel de panel de placas de circuito impreso con procesos de sala limpia a nivel de oblea de semiconductores.<\/p>\n<h2><span class=\"ez-toc-section\" id=\"Key_Differences_Between_Standard_PCBs_and_IC_Substrates\"><\/span>Diferencias clave entre las placas de circuito impreso est\u00e1ndar y los sustratos para circuitos integrados<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>Aunque tanto las placas base est\u00e1ndar como los sustratos de circuitos integrados utilizan pistas conductoras de cobre y capas diel\u00e9ctricas aislantes para conducir las se\u00f1ales el\u00e9ctricas, las similitudes se limitan en gran medida a eso. La diferencia radica en la miniaturizaci\u00f3n extrema de sus componentes, los materiales org\u00e1nicos empleados y las metodolog\u00edas de fabricaci\u00f3n altamente controladas.<\/p>\n<p><strong>Ancho y espaciado de las l\u00edneas (L\/S):<\/strong> Una placa de circuito impreso HDI avanzada t\u00edpica puede presentar anchos de l\u00ednea y espacios de hasta 40 micr\u00f3metros (\u00b5m). En marcado contraste, los sustratos de circuitos integrados modernos exigen habitualmente par\u00e1metros L\/S de 15\/15 \u00b5m, 10\/10 \u00b5m y, en los nodos avanzados de semiconductores, las caracter\u00edsticas inferiores a 5 \u00b5m se est\u00e1n convirtiendo en la norma para soportar densidades masivas de E\/S.<\/p>\n<div style=\"text-align: center;\"><img loading=\"lazy\" decoding=\"async\" alt=\"Sustratos para circuitos integrados\" class=\"aligncenter size-full wp-image-6336\" height=\"380\" src=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/IC-Substrates-2.jpg\" width=\"600\" srcset=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/IC-Substrates-2.jpg 600w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/IC-Substrates-2-300x190.jpg 300w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/IC-Substrates-2-18x12.jpg 18w\" sizes=\"auto, (max-width: 600px) 100vw, 600px\" \/><\/div>\n<p><strong>V\u00edas e interconexiones:<\/strong> Las placas de circuito impreso est\u00e1ndar suelen utilizar v\u00edas perforadas mec\u00e1nicamente, cuyo di\u00e1metro no suele ser inferior a 150 \u00b5m. Los sustratos de circuitos integrados se basan casi exclusivamente en microv\u00edas perforadas con l\u00e1ser, a menudo en el rango de entre 30 y 50 \u00b5m. Estas microv\u00edas suelen rellenarse con cobre mediante ba\u00f1os de galvanoplastia especializados para garantizar v\u00edas el\u00e9ctricas y t\u00e9rmicas robustas entre capas diel\u00e9ctricas ultrafinas sin provocar la formaci\u00f3n de huecos. <strong>M\u00e1s informaci\u00f3n <a href=\"\/es\/blog\/precision-impedance-control-pcb\/\">Control preciso de la impedancia: c\u00f3mo alcanzar una tolerancia de impedancia de \u00b15% en placas de circuito impreso de alta velocidad<\/a>.<\/strong><\/p>\n<p><strong>Estabilidad dimensional y tolerancias:<\/strong> Dado que los sustratos de circuitos integrados deben alinearse directamente con las protuberancias microsc\u00f3picas de un chip de silicio r\u00edgido, sus tolerancias de estabilidad dimensional son microsc\u00f3picas. Cualquier deformaci\u00f3n provocada por una discrepancia en el coeficiente de expansi\u00f3n t\u00e9rmica (CTE) entre el chip de silicio, el sustrato org\u00e1nico y la placa base puede provocar una fatiga catastr\u00f3fica de las uniones de soldadura y su fallo durante los ciclos t\u00e9rmicos.<\/p>\n<h2><span class=\"ez-toc-section\" id=\"Core_Materials_in_IC_Substrate_Manufacturing\"><\/span>Materiales b\u00e1sicos en la fabricaci\u00f3n de sustratos para circuitos integrados<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>Los estrictos requisitos termomec\u00e1nicos y el\u00e9ctricos de alta frecuencia que exige el encapsulado avanzado de circuitos integrados impiden el uso de laminados est\u00e1ndar de fibra de vidrio FR-4 en sustratos de alto rendimiento. En su lugar, la industria recurre a resinas org\u00e1nicas especializadas de alta ingenier\u00eda.<\/p>\n<p><strong>Resina de bismaleimida-triazina (BT):<\/strong> Desarrollada en gran medida por Mitsubishi Gas Chemical, la resina BT es un material b\u00e1sico para el encapsulado de memorias, los MEMS y los procesadores de dispositivos m\u00f3viles. Ofrece una alta temperatura de transici\u00f3n v\u00edtrea (Tg), una excelente estabilidad t\u00e9rmica y una constante diel\u00e9ctrica relativamente baja. Se utiliza habitualmente para sustratos con uni\u00f3n por hilo y encapsulados flip-chip menos complejos, en los que el coste es un factor determinante.<\/p>\n<p><strong>Pel\u00edcula de acumulaci\u00f3n de Ajinomoto (ABF):<\/strong> El ABF es la piedra angular del embalaje para la computaci\u00f3n de alto rendimiento (HPC), las CPU y las GPU. Se trata de una pel\u00edcula a base de epoxi que puede laminarse secuencialmente sin necesidad de refuerzo de fibra de vidrio. La ausencia de fibras de vidrio permite un taladrado por l\u00e1ser incre\u00edblemente preciso y homog\u00e9neo, as\u00ed como un grabado de l\u00edneas finas de cobre altamente predecible. Esto convierte al ABF en el est\u00e1ndar de facto para sustratos masivos y complejos de matriz de bolas en chip invertido (FCBGA).<\/p>\n<p><strong>Poliimida (PI):<\/strong> La poliimida, que se emplea a menudo en sustratos r\u00edgido-flexibles y en aplicaciones especializadas que requieren una resistencia t\u00e9rmica y una flexibilidad extremas, se utiliza con frecuencia en los paquetes de uni\u00f3n automatizada con cinta (TAB) y \u00abchip-on-film\u00bb (COF) para controladores de pantallas.<\/p>\n<h2><span class=\"ez-toc-section\" id=\"Types_of_IC_Substrates\"><\/span>Tipos de sustratos para circuitos integrados<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>Los sustratos para circuitos integrados se clasifican, a grandes rasgos, seg\u00fan la tecnolog\u00eda de encapsulado con fijaci\u00f3n del chip que admiten y su dise\u00f1o estructural interno. <strong>M\u00e1s informaci\u00f3n <a href=\"\/es\/blog\/crosstalk-mitigation-high-speed-pcb\/\">Reducci\u00f3n de la diafon\u00eda: t\u00e9cnicas avanzadas de enrutamiento para minimizar el NEXT y el FEXT en placas de circuito impreso de alta velocidad<\/a>.<\/strong><\/p>\n<p><strong>Sustratos de circuitos integrados para uni\u00f3n por hilo (WB):<\/strong> Estos sustratos est\u00e1n dise\u00f1ados para el ensamblaje tradicional, en el que unos hilos de oro, plata o cobre conectan las almohadillas perif\u00e9ricas del chip al sustrato. Aunque se consideran una tecnolog\u00eda madura y obsoleta, los sustratos WB siguen utiliz\u00e1ndose ampliamente en aplicaciones de IoT en las que el coste es un factor determinante, en m\u00f3dulos de memoria NAND\/DRAM y en circuitos integrados anal\u00f3gicos.<\/p>\n<p><strong>Sustratos para circuitos integrados \u00abflip chip\u00bb (FC):<\/strong> Los sustratos FC est\u00e1n dise\u00f1ados espec\u00edficamente para chips que se colocan invertidos y se unen directamente al sustrato mediante protuberancias de soldadura microsc\u00f3picas (protuberancias C4). Requieren una densidad de enrutamiento significativamente mayor, superficies altamente planas y un control m\u00e1s estricto del coeficiente de expansi\u00f3n t\u00e9rmica (CTE) para evitar el agrietamiento de las protuberancias. Los formatos principales del sector son el FCBGA (Flip Chip Ball Grid Array) y el FCCSP (Flip Chip Chip Scale Package).<\/p>\n<p><strong>Soportes sin n\u00facleo:<\/strong> Los sustratos tradicionales se construyen sim\u00e9tricamente alrededor de un n\u00facleo r\u00edgido de laminado revestido de cobre (CCL) totalmente curado. Los sustratos sin n\u00facleo eliminan por completo este n\u00facleo central. En su lugar, se van superponiendo capas diel\u00e9ctricas y de cobre de forma secuencial sobre una placa portadora temporal que posteriormente se retira. Esta arquitectura permite obtener paquetes globalmente mucho m\u00e1s delgados, una integridad de se\u00f1al superior a frecuencias de varios gigahercios y un enrutamiento m\u00e1s preciso. Sin embargo, plantea enormes retos de fabricaci\u00f3n en lo que respecta al control de la deformaci\u00f3n durante el montaje. <strong>M\u00e1s informaci\u00f3n <a href=\"\/es\/blog\/zero-defect-pcba-aoi-3d-xray\/\">AOI y rayos X 3D: c\u00f3mo lograr un montaje de placas de circuito impreso sin defectos<\/a>.<\/strong><\/p>\n<h2><img loading=\"lazy\" decoding=\"async\" alt=\"Sustratos para circuitos integrados\" class=\"aligncenter size-full wp-image-6334\" height=\"379\" src=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/IC-Substrates.jpg\" width=\"600\" srcset=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/IC-Substrates.jpg 600w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/IC-Substrates-300x190.jpg 300w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/IC-Substrates-18x12.jpg 18w\" sizes=\"auto, (max-width: 600px) 100vw, 600px\" \/><\/h2>\n<h2><span class=\"ez-toc-section\" id=\"How_to_Manufacture_IC_Substrates_Step-by-Step_Guide\"><\/span>C\u00f3mo fabricar sustratos para circuitos integrados (gu\u00eda paso a paso)<span class=\"ez-toc-section-end\"><\/span><\/h2><div class=\"schema-how-to wp-block-yoast-how-to-block\"><p class=\"schema-how-to-description\">Sigue estas normas de ingenier\u00eda. <strong>M\u00e1s informaci\u00f3n <a href=\"\/es\/blog\/bga-underfill-pcba\/\">Relleno de BGA: mejora de la fiabilidad de los PCBA frente a los golpes mec\u00e1nicos y el estr\u00e9s t\u00e9rmico<\/a>.<\/strong><\/p> <ol class=\"schema-how-to-steps\"><li class=\"schema-how-to-step\" id=\"how-to-step-1\"><strong class=\"schema-how-to-step-name\">Selecci\u00f3n de materiales y preparaci\u00f3n del n\u00facleo<\/strong> <p class=\"schema-how-to-step-text\">El proceso comienza con un panel de n\u00facleo r\u00edgido, normalmente un laminado BT o FR-5 revestido de cobre y mec\u00e1nicamente estable. En este n\u00facleo se perforan mec\u00e1nicamente orificios metalizados (PTH) para proporcionar las interconexiones el\u00e9ctricas fundamentales de delante hacia atr\u00e1s. A continuaci\u00f3n, el n\u00facleo se recubre con metal y se graba mediante t\u00e9cnicas sustractivas est\u00e1ndar de PCB para crear las capas de circuito m\u00e1s internas.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-2\"><strong class=\"schema-how-to-step-name\">Perforaci\u00f3n y desmear<\/strong> <p class=\"schema-how-to-step-text\">Se lamina una capa de pel\u00edcula diel\u00e9ctrica, como el ABF, sobre el n\u00facleo en condiciones precisas de calor y vac\u00edo. A continuaci\u00f3n, se utilizan l\u00e1seres ultravioleta (UV) o de CO\u2082 para ablacionar el diel\u00e9ctrico, creando microv\u00edas ciegas que terminan con precisi\u00f3n en las almohadillas de captura de cobre de la capa subyacente. A continuaci\u00f3n se lleva a cabo un proceso qu\u00edmico de desmear, en el que normalmente se utiliza una soluci\u00f3n alcalina de permanganato pot\u00e1sico para eliminar las cenizas del l\u00e1ser y la resina carbonizada de las paredes de las v\u00edas, lo que garantiza un contacto el\u00e9ctrico fiable.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-3\"><strong class=\"schema-how-to-step-name\">Cobreado qu\u00edmico<\/strong> <p class=\"schema-how-to-step-text\">Para preparar el diel\u00e9ctrico aislante para la posterior galvanoplastia, todo el panel se somete a un proceso de recubrimiento de cobre sin corriente. Este ba\u00f1o deposita una capa ultrafina y conformada de cobre puro (normalmente de menos de 1 \u00b5m de espesor) sobre toda la superficie del diel\u00e9ctrico y en el interior de las microv\u00edas perforadas con l\u00e1ser, creando as\u00ed una capa conductora inicial fundamental.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-4\"><strong class=\"schema-how-to-step-name\">Aplicaci\u00f3n de fotorresist de pel\u00edcula seca y litograf\u00eda<\/strong> <p class=\"schema-how-to-step-text\">Se lamina una resina fotosensible de pel\u00edcula seca de alta sensibilidad sobre la capa de semillas de cobre sin corriente reci\u00e9n depositada. Mediante la t\u00e9cnica de imagen directa por l\u00e1ser (LDI) de alta precisi\u00f3n o equipos especializados de litograf\u00eda por pasos, se expone el patr\u00f3n del circuito sobre la resina. La resina no expuesta se elimina mediante un proceso qu\u00edmico de revelado, dejando al descubierto la capa de base de cobre subyacente \u00fanicamente en los canales exactos donde se requieren las pistas conductoras y las almohadillas de v\u00eda.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-5\"><strong class=\"schema-how-to-step-name\">Grabado y litograf\u00eda de patrones (mSAP)<\/strong> <p class=\"schema-how-to-step-text\">El panel se sumerge en un ba\u00f1o de recubrimiento electrol\u00edtico de cobre. Dado que la resina fotosensible de pel\u00edcula seca act\u00faa como aislante el\u00e9ctrico, el cobre solo se deposita en el interior de los canales revelados y en las microv\u00edas, alcanzando as\u00ed el espesor requerido de las pistas. Este paso constituye el n\u00facleo del proceso mSAP. Una vez finalizada la galvanoplastia, la resina fotosensible en pel\u00edcula seca restante se elimina mediante un proceso qu\u00edmico. Por \u00faltimo, se utiliza un proceso de grabado r\u00e1pido altamente controlado para eliminar la capa de semillas de cobre no electrol\u00edtica ultrafina situada entre las pistas, aislando as\u00ed los circuitos sin alterar el perfil rectangular de las l\u00edneas reci\u00e9n recubiertas.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-6\"><strong class=\"schema-how-to-step-name\">Aplicaci\u00f3n de la m\u00e1scara de soldadura<\/strong> <p class=\"schema-how-to-step-text\">Se aplica una m\u00e1scara de soldadura fotoimprimible l\u00edquida (LPSM) especializada y de alta resoluci\u00f3n a las superficies exteriores del sustrato terminado. Se expone y se revela para crear aberturas \u00fanicamente en los puntos donde se unir\u00e1n las protuberancias del chip de silicio y las bolas de soldadura del BGA de la placa base. Esta capa protege el resto de las pistas ultrafinas contra la oxidaci\u00f3n, la contaminaci\u00f3n y la formaci\u00f3n de puentes de soldadura durante el montaje.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-7\"><strong class=\"schema-how-to-step-name\">Acabado superficial<\/strong> <p class=\"schema-how-to-step-text\">Las almohadillas de cobre expuestas deben protegerse contra la oxidaci\u00f3n para garantizar una excelente soldabilidad durante el proceso final de montaje del circuito integrado. Entre los acabados superficiales de alto rendimiento m\u00e1s habituales para los sustratos de circuitos integrados se incluyen el n\u00edquel qu\u00edmico, el paladio qu\u00edmico y el oro por inmersi\u00f3n (ENEPIG), los conservantes org\u00e1nicos de soldabilidad (OSP) o el esta\u00f1o por inmersi\u00f3n, que se eligen en funci\u00f3n de los requisitos metal\u00fargicos espec\u00edficos de los bultos del chip.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-8\"><strong class=\"schema-how-to-step-name\">Inspecci\u00f3n y pruebas<\/strong> <p class=\"schema-how-to-step-text\">El panel de sustrato final se somete a una rigurosa inspecci\u00f3n \u00f3ptica automatizada (AOI) para detectar \u00f3pticamente cortocircuitos microsc\u00f3picos, interrupciones y deformaciones en las pistas. Las pruebas el\u00e9ctricas con sonda voladora o \u00abbed-of-nails\u00bb verifican la continuidad y el aislamiento de alta tensi\u00f3n de las complejas redes. Por \u00faltimo, se llevan a cabo estrictos controles metrol\u00f3gicos para garantizar que los sustratos individuales permanezcan completamente planos y dentro de tolerancias de deformaci\u00f3n muy estrictas (a menudo medidas en meros micr\u00f3metros) antes de ser cortados en chips y enviados a las instalaciones de OSAT (ensamblaje y prueba de semiconductores subcontratados).<\/p> <\/li><\/ol><\/div><p>La fabricaci\u00f3n de un sustrato avanzado para circuitos integrados, en concreto un sustrato ABF de alta densidad, es un proceso de acumulaci\u00f3n secuencial (SBU) sumamente complejo. Para conseguir trazas de cobre ultrafinas, se recurre principalmente al proceso semiaditivo modificado (mSAP), en lugar del grabado sustractivo.<\/p>\n<h2><span class=\"ez-toc-section\" id=\"The_Role_of_mSAP_Modified_Semi-Additive_Process\"><\/span>El papel del mSAP (proceso semiaditivo modificado)<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>Para comprender el salto de la fabricaci\u00f3n tradicional de placas de circuito impreso (PCB) a la fabricaci\u00f3n de sustratos para circuitos integrados (IC), es necesario entender la necesidad del mSAP. En un proceso sustractivo est\u00e1ndar de fabricaci\u00f3n de PCB, se graba una l\u00e1mina gruesa de cobre para dejar las pistas funcionales. A medida que las geometr\u00edas de las pistas se acercan entre s\u00ed (por debajo de los 40 \u00b5m), el producto qu\u00edmico de grabado ataca las paredes laterales de las pistas, creando una secci\u00f3n transversal trapezoidal que puede provocar una grave p\u00e9rdida de se\u00f1al de alta frecuencia o un fallo estructural.<\/p>\n<p>El proceso semiaditivo modificado supera esta limitaci\u00f3n partiendo de un diel\u00e9ctrico pr\u00e1cticamente desnudo, a\u00f1adiendo una capa de semillas microsc\u00f3pica y recubriendo con cobre mediante galvanoplastia. <em>hacia arriba<\/em> en un molde de fotorresina. La etapa final de grabado r\u00e1pido solo elimina la capa de semillas, de un espesor de un nan\u00f3metro, lo que da como resultado pistas de cobre perfectamente rectangulares y de gran fiabilidad, con espacios entre l\u00edneas de hasta 5 \u00b5m o menos. La tecnolog\u00eda mSAP constituye el puente tecnol\u00f3gico fundamental entre la planta de fabricaci\u00f3n de placas de circuito impreso a escala macro y la fundici\u00f3n de semiconductores a escala nanom\u00e9trica.<\/p>\n<h2><span class=\"ez-toc-section\" id=\"Advanced_Packaging_and_the_Future_of_IC_Substrates\"><\/span>El encapsulado avanzado y el futuro de los sustratos para circuitos integrados<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>Dado que la Ley de Moore se enfrenta a obst\u00e1culos f\u00edsicos y econ\u00f3micos insuperables, la industria de los semiconductores est\u00e1 dando un giro radical hacia la integraci\u00f3n heterog\u00e9nea y las arquitecturas de encapsulado avanzadas. En lugar de dise\u00f1ar un \u00fanico chip monol\u00edtico de silicio de gran tama\u00f1o, los ingenieros est\u00e1n adoptando arquitecturas de \u00abchiplets\u00bb. En este enfoque, se unen en un \u00fanico encapsulado m\u00faltiples chips m\u00e1s peque\u00f1os y especializados (como n\u00facleos de CPU, aceleradores de GPU, memoria HBM y controladores de E\/S).<\/p>\n<p>Este cambio de paradigma plantea exigencias sin precedentes al sustrato de los circuitos integrados. Ya no es solo un transformador pasivo de espacio, sino que constituye la columna vertebral de comunicaci\u00f3n activa y de gran ancho de banda de todo el sistema computacional. Los sustratos del futuro requerir\u00e1n un enrutamiento a\u00fan m\u00e1s preciso, utilizando sustratos de trazas integradas (ETS), en los que las trazas de cobre se hunden directamente en el diel\u00e9ctrico para mejorar la integridad de la se\u00f1al, as\u00ed como dise\u00f1os sin n\u00facleo cada vez m\u00e1s complejos que permitan el suministro vertical de energ\u00eda. Si bien los interpositores de silicio (utilizados en el encapsulado 2,5D) gestionan actualmente las densidades de interconexi\u00f3n entre chips m\u00e1s extremas, los sustratos org\u00e1nicos avanzados est\u00e1n evolucionando r\u00e1pidamente para ofrecer un ancho de banda similar entre m\u00faltiples chips a una fracci\u00f3n del coste. Esto garantiza que la evoluci\u00f3n continua del sustrato de circuitos integrados seguir\u00e1 siendo un factor clave y una frontera altamente competitiva de la innovaci\u00f3n en hardware durante las pr\u00f3ximas d\u00e9cadas.<\/p>\n<h2><span class=\"ez-toc-section\" id=\"Frequently_Asked_Questions_FAQ\"><\/span>Preguntas Frecuentes (FAQ)<span class=\"ez-toc-section-end\"><\/span><\/h2><div class=\"schema-faq wp-block-yoast-faq-block\"><div class=\"schema-faq-section\" id=\"faq-question-1\"><strong class=\"schema-faq-question\">\u00bfCu\u00e1l es la funci\u00f3n principal de un sustrato de circuito integrado?<\/strong> <p class=\"schema-faq-answer\">La funci\u00f3n principal de un sustrato de circuito integrado es actuar como interfaz electromec\u00e1nica fundamental entre un circuito integrado sin encapsular (chip) y una placa de circuito impreso (PCB). Este sustrato adapta las almohadillas de E\/S microsc\u00f3picas y de alta densidad del chip de silicio a las almohadillas m\u00e1s grandes y con mayor separaci\u00f3n entre s\u00ed que se necesitan para soldar el encapsulado a una placa base, al tiempo que proporciona soporte estructural, enrutamiento de se\u00f1ales y una disipaci\u00f3n t\u00e9rmica fundamental.<\/p> <\/div> <div class=\"schema-faq-section\" id=\"faq-question-2\"><strong class=\"schema-faq-question\">\u00bfEn qu\u00e9 se diferencia un sustrato de circuito integrado de una placa de circuito impreso (PCB) tradicional de interconexi\u00f3n de alta densidad (HDI)?<\/strong> <p class=\"schema-faq-answer\">Aunque ambos utilizan microv\u00edas y pistas en capas, los sustratos de circuitos integrados funcionan a una escala f\u00edsica significativamente menor. Los sustratos de circuitos integrados requieren anchos de l\u00ednea y espaciados (L\/S) de entre 5 y 15 micr\u00f3metros, mientras que las placas de circuito impreso HDI avanzadas suelen funcionar en torno a los 40 micr\u00f3metros. Adem\u00e1s, los sustratos de circuitos integrados se basan en materiales org\u00e1nicos especializados, como la resina ABF, y emplean procesos semiaditivos modificados (mSAP) en lugar de los laminados FR4 est\u00e1ndar y el grabado sustractivo.<\/p> <\/div> <div class=\"schema-faq-section\" id=\"faq-question-3\"><strong class=\"schema-faq-question\">\u00bfQu\u00e9 es el ABF y por qu\u00e9 es fundamental para los sustratos de circuitos integrados?<\/strong> <p class=\"schema-faq-answer\">ABF son las siglas de \u00abAjinomoto Build-up Film\u00bb. Se trata de una resina diel\u00e9ctrica altamente especializada, de base epoxi, que se presenta en forma de pel\u00edcula, lo que permite la laminaci\u00f3n secuencial sin necesidad del refuerzo tradicional con fibra de vidrio. Es absolutamente crucial, ya que su estructura homog\u00e9nea permite un taladrado por l\u00e1ser incre\u00edblemente preciso de microv\u00edas y el grabado de l\u00edneas de cobre ultrafinas, requisitos imprescindibles para los procesadores flip-chip de alto rendimiento y las arquitecturas de chiplets.<\/p> <\/div> <div class=\"schema-faq-section\" id=\"faq-question-4\"><strong class=\"schema-faq-question\">\u00bfEn qu\u00e9 consiste el proceso semiaditivo modificado (mSAP) que se utiliza en la fabricaci\u00f3n de sustratos para circuitos integrados?<\/strong> <p class=\"schema-faq-answer\">El mSAP es una t\u00e9cnica avanzada de recubrimiento electroqu\u00edmico. En lugar de grabar el cobre grueso para formar las pistas (m\u00e9todo sustractivo), el mSAP parte de una capa inicial de cobre muy fina. Se aplica un molde de fotorresina y se deposita cobre mediante galvanoplastia *hacia arriba* para formar las pistas densas. Un breve grabado r\u00e1pido final elimina la fina capa de base entre las l\u00edneas, lo que da como resultado pistas rectangulares de gran precisi\u00f3n que son estructuralmente imposibles de conseguir con el grabado est\u00e1ndar de placas de circuito impreso.<\/p> <\/div> <div class=\"schema-faq-section\" id=\"faq-question-5\"><strong class=\"schema-faq-question\">\u00bfSustituir\u00e1n los sustratos sin n\u00facleo a los sustratos tradicionales para circuitos integrados con n\u00facleo?<\/strong> <p class=\"schema-faq-answer\">Los sustratos sin n\u00facleo est\u00e1n ganando r\u00e1pidamente una cuota de mercado significativa, sobre todo en aplicaciones de alta velocidad y alta frecuencia, como los m\u00f3dulos de RF 5G y los procesadores m\u00f3viles avanzados, ya que permiten obtener paquetes mucho m\u00e1s delgados y una integridad de se\u00f1al superior. Sin embargo, los sustratos tradicionales con n\u00facleo siguen siendo esenciales para los chips de servidores de computaci\u00f3n de alto rendimiento (HPC) a gran escala, que requieren una enorme rigidez estructural para evitar el agrietamiento del chip y la deformaci\u00f3n del encapsulado durante el montaje. De cara al futuro, ambas tecnolog\u00edas coexistir\u00e1n en funci\u00f3n de la aplicaci\u00f3n espec\u00edfica y de los requisitos termomec\u00e1nicos.<\/p> <\/div> <\/div>","protected":false},"excerpt":{"rendered":"<p>Introduction to IC Substrates In the highly specialized field of semiconductor manufacturing and electronics assembly, the integrated circuit (IC) substrate serves as the critical electrochemical and thermomechanical interface between a bare silicon die and the main printed circuit board (PCB). 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