{"id":6248,"date":"2026-09-15T08:00:00","date_gmt":"2026-09-15T00:00:00","guid":{"rendered":"https:\/\/www.topfastpcb.com\/?p=6248"},"modified":"2026-08-05T18:33:49","modified_gmt":"2026-08-05T10:33:49","slug":"return-path-optimization-si","status":"publish","type":"post","link":"https:\/\/www.topfastpcb.com\/it\/blog\/return-path-optimization-si\/","title":{"rendered":"Ottimizzazione del percorso di ritorno: progettazione di piani di riferimento solidi per l'integrit\u00e0 del segnale ad alta frequenza"},"content":{"rendered":"<p>Nel campo della progettazione avanzata dei circuiti stampati (PCB), gli ingegneri spesso si concentrano in modo particolare sull\u2019instradamento delle tracce di segnale, regolandone meticolosamente le lunghezze, adattando le impedenze e instradando le coppie differenziali con estrema precisione. Tuttavia, una traccia di segnale rappresenta solo una met\u00e0 dell\u2019equazione elettrica. Ogni segnale elettrico richiede un circuito chiuso completo per fluire, il che significa che la corrente di ritorno deve ritrovare la strada per tornare alla sorgente. Il percorso che questa corrente di ritorno segue \u00e8 noto come percorso di ritorno, e la sua gestione \u00e8 fondamentale. L\u2019ottimizzazione del percorso di ritorno \u00e8 senza dubbio l\u2019aspetto pi\u00f9 cruciale per garantire l\u2019integrit\u00e0 del segnale ad alta frequenza nell\u2019elettronica moderna.<\/p>\n<p>Con l'aumentare delle velocit\u00e0 di commutazione e l'accelerazione delle velocit\u00e0 di salita nei moderni sistemi digitali e RF, il comportamento delle correnti di ritorno subisce cambiamenti radicali. La mancata realizzazione di un percorso di ritorno continuo e a bassa impedenza comporta una serie di problemi relativi all\u2019integrit\u00e0 del segnale (SI) e alle interferenze elettromagnetiche (EMI), che vanno da gravi fenomeni di crosstalk e ground bounce a livelli inaccettabili di emissioni irradiate. La progettazione di piani di riferimento solidi \u00e8 la strategia fondamentale per mitigare questi problemi e garantire un funzionamento affidabile e ad alte prestazioni dei PCB.<\/p>\n<div style=\"text-align: center;\"><img loading=\"lazy\" decoding=\"async\" src=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Return-Path-Optimization-1.jpg\" alt=\"Ottimizzazione del percorso di ritorno\" width=\"600\" height=\"400\" class=\"aligncenter size-full wp-image-6422\" srcset=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Return-Path-Optimization-1.jpg 600w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Return-Path-Optimization-1-300x200.jpg 300w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Return-Path-Optimization-1-18x12.jpg 18w\" sizes=\"auto, (max-width: 600px) 100vw, 600px\" \/><\/div>\n<p>La fisica delle correnti di ritorno: resistenza contro induttanza <strong>Per saperne di pi\u00f9 <a href=\"\/it\/blog\/zero-defect-pcba-aoi-3d-xray\/\">AOI e radiografia 3D: verso un assemblaggio di circuiti stampati a zero difetti<\/a>.<\/strong><\/p>\n<p>Per padroneggiare l\u2019ottimizzazione del percorso di ritorno, occorre innanzitutto comprendere come si comporta la corrente alle diverse frequenze. La regola fondamentale dell\u2019elettricit\u00e0 afferma che la corrente segue sempre il percorso di minore impedenza. L\u2019impedenza ($Z$) comprende sia la resistenza ($R$) che la reattanza ($X$), fortemente influenzata dall\u2019induttanza ($L$) alle frequenze pi\u00f9 elevate ($Z = R + j\\omega L$, dove $\\omega$ \u00e8 la frequenza angolare). <strong>Per saperne di pi\u00f9 <a href=\"\/it\/blog\/smt-assembly-fine-pitch-bga-01005\/\">Assemblaggio SMT di circuiti stampati (PCBA): padronanza dei BGA a passo fine e dei componenti 01005<\/a>.<\/strong><\/p>\n<p>In presenza di corrente continua (CC) o di frequenze molto basse, la componente reattiva \u00e8 trascurabile. Pertanto, la corrente di ritorno segue il percorso di minor resistenza. In un piano di massa solido, la corrente di ritorno in CC si diffonde ampiamente, seguendo un percorso diretto e rettilineo dal carico alla sorgente, indipendentemente dal tracciato del segnale sugli strati superiori.<\/p>\n<p>Tuttavia, all\u2019aumentare della frequenza (tipicamente al di sopra dei 100 kHz, e certamente nelle gamme dei MHz e dei GHz caratteristiche dei moderni progetti ad alta velocit\u00e0), la reattanza induttiva domina l\u2019equazione dell\u2019impedenza. La corrente di ritorno in CA ad alta frequenza non segue pi\u00f9 il percorso di minima resistenza, ma quello di minima induttanza. Il percorso a induttanza minima si ottiene riducendo al minimo l\u2019area dell\u2019anello tra il percorso del segnale in uscita e quello della corrente di ritorno. Di conseguenza, le correnti di ritorno ad alta frequenza si concentrano direttamente sotto la traccia del segnale sul piano di riferimento adiacente. Questo fenomeno \u00e8 noto come effetto di prossimit\u00e0. Quando una traccia si snoda a stretto contatto su un piano di riferimento solido e ininterrotto, la corrente di ritorno forma una banda stretta e concentrata proprio sotto di essa, riducendo al minimo l\u2019induttanza dell\u2019anello e garantendo un\u2019integrit\u00e0 del segnale ottimale. <strong>Per saperne di pi\u00f9 <a href=\"\/it\/blog\/conformal-coating-pcba\/\">Rivestimento conforme: protezione dei circuiti stampati (PCBA) da umidit\u00e0, polvere e ambienti corrosivi<\/a>.<\/strong><\/p>\n<div style=\"text-align: center;\"><img loading=\"lazy\" decoding=\"async\" src=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Return-Path-Optimization-2.jpg\" alt=\"Ottimizzazione del percorso di ritorno\" width=\"600\" height=\"400\" class=\"aligncenter size-full wp-image-6423\" srcset=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Return-Path-Optimization-2.jpg 600w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Return-Path-Optimization-2-300x200.jpg 300w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Return-Path-Optimization-2-18x12.jpg 18w\" sizes=\"auto, (max-width: 600px) 100vw, 600px\" \/><\/div>\n<div id=\"ez-toc-container\" class=\"ez-toc-v2_0_74 counter-hierarchy ez-toc-counter ez-toc-custom ez-toc-container-direction\">\n<div class=\"ez-toc-title-container\">\n<p class=\"ez-toc-title\" style=\"cursor:inherit\">Indice per materie<\/p>\n<span class=\"ez-toc-title-toggle\"><\/span><\/div>\n<nav><ul class='ez-toc-list ez-toc-list-level-1' ><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-1\" href=\"https:\/\/www.topfastpcb.com\/it\/blog\/return-path-optimization-si\/#The_Impact_of_Discontinuous_Return_Paths\" >L'impatto dei percorsi di ritorno discontinui<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-2\" href=\"https:\/\/www.topfastpcb.com\/it\/blog\/return-path-optimization-si\/#How_to_Optimize_Return_Paths_Step-by-Step_Guide\" >Come ottimizzare i percorsi di ritorno (guida passo dopo passo)<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-3\" href=\"https:\/\/www.topfastpcb.com\/it\/blog\/return-path-optimization-si\/#Advanced_Techniques_and_Considerations\" >Tecniche avanzate e considerazioni<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-4\" href=\"https:\/\/www.topfastpcb.com\/it\/blog\/return-path-optimization-si\/#Conclusion\" >conclusioni<\/a><\/li><li class='ez-toc-page-1 ez-toc-heading-level-2'><a class=\"ez-toc-link ez-toc-heading-5\" href=\"https:\/\/www.topfastpcb.com\/it\/blog\/return-path-optimization-si\/#Frequently_Asked_Questions_FAQ\" >Domande frequenti (FAQ)<\/a><\/li><\/ul><\/nav><\/div>\n<h2><span class=\"ez-toc-section\" id=\"The_Impact_of_Discontinuous_Return_Paths\"><\/span>L'impatto dei percorsi di ritorno discontinui<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>Quando il percorso di minima induttanza viene interrotto, la corrente di ritorno \u00e8 costretta a deviare dal suo percorso ideale al di sotto della traccia del segnale. Questa deviazione aumenta l'area fisica del circuito, il che comporta un aumento diretto dell'induttanza del circuito. Un'area del circuito pi\u00f9 ampia funge da antenna a circuito altamente efficiente, irradiando energia elettromagnetica e causando gravi problemi di interferenze elettromagnetiche (EMI).<\/p>\n<p>Inoltre, le discontinuit\u00e0 nel percorso di ritorno compromettono l'integrit\u00e0 del segnale in diversi modi specifici:<br \/>&#8211; <strong>Discontinuit\u00e0 di impedenza:<\/strong> L'impedenza caratteristica di una traccia viene calcolata in base alla sua geometria rispetto al piano di riferimento pi\u00f9 vicino. Se il piano viene interrotto (ad esempio, in corrispondenza di una divisione), la capacit\u00e0 rispetto al piano di riferimento diminuisce, causando un improvviso picco dell'impedenza caratteristica. Questo disallineamento provoca riflessioni del segnale, oscillazioni e un deterioramento dei diagrammi a occhio.<br \/>&#8211; <strong>Escalation dei problemi di diafonia<\/strong>: Quando le correnti di ritorno provenienti da pi\u00f9 segnali sono costrette a aggirare un ostacolo (come un vuoto o una fessura), convergono in aree condivise e localizzate. Questa condivisione del percorso di ritorno crea un accoppiamento ad impedenza comune, aumentando notevolmente la diafonia tra segnali che altrimenti sarebbero ben isolati.<br \/>&#8211; <strong>Rimbalzo a terra e rumore di alimentazione<\/strong>: I percorsi di ritorno non ottimizzati contribuiscono alla formazione di induttanza parassita nelle reti di terra e di distribuzione dell'alimentazione (PDN). Le correnti di commutazione rapida che attraversano questa induttanza generano transitori di tensione ($V = L(di\/dt)$), causando il \u00abground bounce\u00bb (rumore da commutazione simultanea) e il calo di tensione dell\u2019alimentazione, con il rischio di provocare errori logici nei circuiti integrati digitali ad alta velocit\u00e0.<\/p>\n<p>Tra le cause pi\u00f9 comuni delle discontinuit\u00e0 nel percorso di ritorno figurano il tracciamento di linee attraverso punti di separazione tra diversi domini di alimentazione o di massa, il tracciamento su via anti-pad (fori di distanziamento) densamente raggruppati e il cambio di strati di riferimento senza fornire un adeguato percorso di ritorno che la corrente possa seguire. <strong>Per saperne di pi\u00f9 <a href=\"\/it\/blog\/stacked-vs-staggered-microvias-hdi\/\">Microvie impilate e sfalsate: regole di progettazione e affidabilit\u00e0 nei circuiti stampati ad alta densit\u00e0 di interconnessione (HDI)<\/a>.<\/strong><\/p>\n<h2><img loading=\"lazy\" decoding=\"async\" src=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Return-Path-Optimization.jpg\" alt=\"Ottimizzazione del percorso di ritorno\" width=\"600\" height=\"400\" class=\"aligncenter size-full wp-image-6421\" srcset=\"https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Return-Path-Optimization.jpg 600w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Return-Path-Optimization-300x200.jpg 300w, https:\/\/www.topfastpcb.com\/wp-content\/uploads\/2026\/08\/Return-Path-Optimization-18x12.jpg 18w\" sizes=\"auto, (max-width: 600px) 100vw, 600px\" \/><\/h2>\n<h2><span class=\"ez-toc-section\" id=\"How_to_Optimize_Return_Paths_Step-by-Step_Guide\"><\/span>Come ottimizzare i percorsi di ritorno (guida passo dopo passo)<span class=\"ez-toc-section-end\"><\/span><\/h2><div class=\"schema-how-to wp-block-yoast-how-to-block\"><p class=\"schema-how-to-description\">Attenetevi a queste regole tecniche.<\/p> <ol class=\"schema-how-to-steps\"><li class=\"schema-how-to-step\" id=\"how-to-step-1\"><strong class=\"schema-how-to-step-name\">Identificare i segnali critici ad alta velocit\u00e0<\/strong> <p class=\"schema-how-to-step-text\">Prima di iniziare il routing, classificare le reti presenti nello schema. Identificare tutti i segnali digitali ad alta velocit\u00e0 (come PCIe, DDR, USB, HDMI e Gigabit Ethernet), i segnali di clock e le tracce RF. Queste reti critiche sono altamente sensibili alle discontinuit\u00e0 del percorso di ritorno e devono essere instradate con la massima priorit\u00e0. Stabilire regole di progettazione rigorose relative ai valori di impedenza target e alle transizioni di strato consentite per queste reti specifiche.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-2\"><strong class=\"schema-how-to-step-name\">Assegna piani di riferimento solidi adiacenti<\/strong> <p class=\"schema-how-to-step-text\">Definire con cura la struttura del PCB. Assicurarsi che ogni strato di segnale destinato al routing ad alta velocit\u00e0 sia immediatamente adiacente a un piano di riferimento in rame massiccio. Un piano di massa continuo \u00e8 sempre il riferimento preferibile perch\u00e9 mantiene uno stato equipotenziale e non trasporta correnti di alimentazione in corrente continua. Lo spessore del dielettrico tra la traccia di segnale e il relativo piano di riferimento deve essere ridotto al minimo (in genere da 3 a 5 mil) per accoppiare strettamente la corrente di ritorno alla traccia e ridurre al minimo le emissioni irradiate.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-3\"><strong class=\"schema-how-to-step-name\">Tracciati di percorso senza attraversare le divisioni piane<\/strong> <p class=\"schema-how-to-step-text\">La regola fondamentale per l\u2019ottimizzazione del percorso di ritorno \u00e8 quella di non instradare mai un segnale ad alta velocit\u00e0 attraverso una divisione o uno spazio vuoto nel piano di riferimento adiacente. Quando si definiscono domini di terra isolati o piani di alimentazione divisi, assicurarsi che gli spazi vuoti non intersecino i percorsi di instradamento dei segnali critici. Se una traccia deve attraversare una divisione per assoluta necessit\u00e0, \u00e8 necessario prevedere un ponte strettamente accoppiato \u2014 come un condensatore di collegamento posizionato direttamente adiacente al punto di attraversamento \u2014 per consentire alle correnti di ritorno CA ad alta frequenza di superare la divisione con un'espansione minima dell'area del loop.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-4\"><strong class=\"schema-how-to-step-name\">Prevedere fori di collegamento per le transizioni tra gli strati<\/strong> <p class=\"schema-how-to-step-text\">Quando una traccia ad alta velocit\u00e0 passa da uno strato all\u2019altro, anche la corrente di ritorno deve passare al nuovo piano di riferimento. Se la traccia si sposta da uno strato con riferimento a massa a un altro strato con riferimento a massa, posizionare un via di collegamento a massa il pi\u00f9 vicino possibile, fisicamente, al via del segnale (idealmente entro 40 mil). Ci\u00f2 fornisce un percorso diretto e a bassa induttanza che consente alla corrente di ritorno di passare da un piano all\u2019altro. Se la traccia passa da uno strato con riferimento a massa a uno con riferimento all\u2019alimentazione, posizionare un condensatore di disaccoppiamento di dimensioni adeguate proprio accanto al via di segnale per facilitare il trasferimento della corrente di ritorno tra i piani.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-5\"><strong class=\"schema-how-to-step-name\">Ridurre al minimo gli anti-pad e i vuoti piani<\/strong> <p class=\"schema-how-to-step-text\">I componenti a foro passante, i connettori e le matrici di via ad alta densit\u00e0 richiedono fori di scarico (anti-pad) nei piani interni in rame per prevenire cortocircuiti. Tuttavia, anti-pad eccessivamente grandi o sovrapposti possono fondersi formando enormi vuoti, interrompendo completamente il piano di riferimento. Ottimizzare con cura le dimensioni degli anti-pad dei via per garantire che tra i via rimanga una \u201crete\u201d continua di rame. Ci\u00f2 assicura che le correnti di ritorno possano fluire senza ostacoli tra i via, anzich\u00e9 essere costrette a deviare completamente attorno alla matrice.<\/p> <\/li><li class=\"schema-how-to-step\" id=\"how-to-step-6\"><strong class=\"schema-how-to-step-name\">Verifica dei percorsi di ritorno con strumenti di simulazione<\/strong> <p class=\"schema-how-to-step-text\">Affidarsi esclusivamente all\u2019ispezione visiva non \u00e8 sufficiente per schede complesse e ad alta densit\u00e0. Utilizzate strumenti avanzati di Electronic Design Automation (EDA) e di risoluzione dei campi elettromagnetici (EM) in 3D per eseguire simulazioni di integrit\u00e0 del segnale e di integrit\u00e0 dell\u2019alimentazione. Questi strumenti consentono di visualizzare la densit\u00e0 della corrente di ritorno, individuare con precisione le aree caratterizzate da un\u2019elevata induttanza di loop e prevedere con accuratezza le interferenze elettromagnetiche (EMI) e il crosstalk derivanti da sottili scelte di layout. Eseguite queste simulazioni in modo iterativo durante la fase di layout per individuare e correggere le violazioni del percorso di ritorno prima della produzione finale.<br\/><br\/><\/p> <\/li><\/ol><\/div><h2><span class=\"ez-toc-section\" id=\"Advanced_Techniques_and_Considerations\"><\/span>Tecniche avanzate e considerazioni<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>Sebbene i piani di massa rappresentino il riferimento ideale, i moderni progetti ad alta densit\u00e0 costringono spesso gli ingegneri a utilizzare i piani di alimentazione come piani di riferimento per alcuni strati di segnale. I segnali CA ad alta frequenza non distinguono tra VCC e GND; per un segnale CA, un piano di alimentazione solido e a bassa impedenza appare esattamente come un piano di massa. Tuttavia, l\u2019avvertenza fondamentale \u00e8 che la corrente di ritorno su un piano di alimentazione deve alla fine ritrovare la via per tornare al riferimento di massa del dispositivo sorgente. Ci\u00f2 richiede una rete di distribuzione dell\u2019alimentazione (PDN) a impedenza ultra-bassa e il posizionamento strategico di condensatori di disaccoppiamento a livello del driver e del ricevitore del segnale per ricollegare la corrente di ritorno CA dal piano di alimentazione al piano di massa.<\/p>\n<p>Nei progetti RF a frequenze estremamente elevate (ad esempio, radar a onde millimetriche o comunicazioni 5G), il tracciamento standard su microstriscia o striscia lineare pu\u00f2 comportare un\u2019eccessiva radiazione o perdite dielettriche. In questi casi, gli ingegneri ricorrono spesso al tracciamento su guida d\u2019onda coplanare (CPW). Il CPW posiziona la traccia del segnale e la sua massa di riferimento sullo stesso strato, accoppiandole strettamente tramite una specifica larghezza di spazio. La massa di livello superiore viene quindi collegata intensamente tramite vie a un piano di massa solido sottostante per garantire un percorso di ritorno robusto e ininterrotto e un eccellente isolamento dai circuiti adiacenti.<\/p>\n<p>Inoltre, occorre tenere conto dei limiti fisici del processo di fabbricazione dei PCB. \u00c8 necessario assicurarsi che lo spessore del rame dei piani di riferimento sia sufficiente a gestire eventuali correnti continue (se fungono da piano di alimentazione) senza cadute di tensione eccessive, mantenendo al contempo un\u2019estrema planarit\u00e0 per garantire un\u2019impedenza uniforme su tutto il profilo della scheda. Anche l\u2019allineamento meticoloso degli strati durante la pressatura \u00e8 fondamentale per garantire la distanza precisa tra la traccia e il piano di riferimento definita nei modelli SI.<\/p>\n<h2><span class=\"ez-toc-section\" id=\"Conclusion\"><\/span>conclusioni<span class=\"ez-toc-section-end\"><\/span><\/h2>\n<p>L'ottimizzazione del percorso di ritorno non \u00e8 semplicemente una best practice raccomandata; \u00e8 una necessit\u00e0 fisica assoluta per il funzionamento affidabile dei circuiti elettronici ad alta frequenza. Interiorizzando il principio secondo cui le correnti ad alta frequenza seguono il percorso di minima induttanza, gli ingegneri possono progettare in modo proattivo piani di riferimento solidi e ininterrotti. Grazie a un'attenta progettazione dello stack-up, a strategie di instradamento che evitino la frammentazione dei piani e all'uso strategico di vie di collegamento e condensatori, \u00e8 possibile preservare in modo robusto l\u2019integrit\u00e0 dei segnali ad alta velocit\u00e0. In definitiva, una forte attenzione al percorso di ritorno eleva la progettazione di un PCB da funzionalmente adeguata a altamente ottimizzata, immune alle interferenze elettromagnetiche (EMI) e pronta per le rigorose esigenze della tecnologia di prossima generazione.<\/p>\n<p>Per ottenere un'integrit\u00e0 del segnale ottimale \u00e8 necessario adottare un approccio mirato e proattivo alla progettazione del piano di riferimento e all'instradamento delle tracce. Seguite questo processo sistematico per ottimizzare i percorsi di ritorno nei vostri progetti di PCB ad alta frequenza.<\/p>\n<h2><span class=\"ez-toc-section\" id=\"Frequently_Asked_Questions_FAQ\"><\/span>Domande frequenti (FAQ)<span class=\"ez-toc-section-end\"><\/span><\/h2><div class=\"schema-faq wp-block-yoast-faq-block\"><div class=\"schema-faq-section\" id=\"faq-question-1\"><strong class=\"schema-faq-question\">Cosa succede se una traccia ad alta velocit\u00e0 attraversa una divisione nel piano di riferimento?<\/strong> <p class=\"schema-faq-answer\">Quando una traccia ad alta velocit\u00e0 attraversa una divisione piana, la corrente di ritorno, fortemente accoppiata, viene bloccata e costretta a deviare lungo il perimetro della divisione per trovare un percorso continuo di ritorno alla sorgente. Questo massiccio aumento dell\u2019area del circuito di corrente fa crescere drasticamente l\u2019induttanza del circuito, causando un grave disadattamento di impedenza, riflessioni del segnale, attenuazione del segnale e significative interferenze elettromagnetiche irradiate (EMI).<\/p> <\/div> <div class=\"schema-faq-section\" id=\"faq-question-2\"><strong class=\"schema-faq-question\">Posso utilizzare un piano di alimentazione come piano di riferimento per i segnali ad alta frequenza?<\/strong> <p class=\"schema-faq-answer\">S\u00ec, i segnali CA ad alta frequenza considerano qualsiasi piano continuo in rame (sia esso di alimentazione o di massa) come un piano di riferimento adeguato. Tuttavia, se un segnale \u00e8 referenziato a un piano di alimentazione, la corrente di ritorno deve alla fine ricollegarsi alla massa del sistema. Ci\u00f2 richiede un posizionamento accurato dei condensatori di disaccoppiamento ad alta frequenza in prossimit\u00e0 del driver e del ricevitore, per consentire alla corrente di ritorno in CA di passare tra i piani di alimentazione e di massa senza incontrare un'induttanza elevata.<\/p> <\/div> <div class=\"schema-faq-section\" id=\"faq-question-3\"><strong class=\"schema-faq-question\">Quanti fori di collegamento sono necessari quando un segnale passa da uno strato all'altro?<\/strong> <p class=\"schema-faq-answer\">Come regola generale per i segnali digitali ad alta velocit\u00e0, \u00e8 necessario posizionare almeno un via di collegamento per ogni via di segnale quando si passa da uno strato all\u2019altro riferiti alla stessa rete di piano (ad esempio, da GND a GND). Il via di collegamento deve essere posizionato il pi\u00f9 vicino possibile al via di segnale, nei limiti consentiti dalle tolleranze di produzione (idealmente entro 30-40 mil), per ridurre al minimo l\u2019induttanza del circuito della transizione tra strati. Per i segnali altamente critici o differenziali, spesso si utilizzano due via di collegamento simmetrici per garantire un percorso di ritorno ottimale e bilanciato.<\/p> <\/div> <div class=\"schema-faq-section\" id=\"faq-question-4\"><strong class=\"schema-faq-question\">Qual \u00e8 la differenza tra un percorso di ritorno in corrente continua e un percorso di ritorno alle alte frequenze?<\/strong> <p class=\"schema-faq-answer\">In corrente continua (CC) e a frequenze molto basse, la corrente segue il percorso di minima resistenza. La corrente di ritorno si distribuisce su tutto il piano di riferimento e percorre la distanza fisica pi\u00f9 breve, in linea retta, per tornare alla sorgente. Alle alte frequenze (generalmente &gt; 100 kHz), la reattanza induttiva domina l\u2019equazione dell\u2019impedenza. La corrente segue il percorso di minima induttanza, che si forma naturalmente direttamente sotto la traccia del segnale in uscita, riducendo al minimo l\u2019area dell\u2019anello.<\/p> <\/div> <div class=\"schema-faq-section\" id=\"faq-question-5\"><strong class=\"schema-faq-question\">Quanto deve essere vicino il piano di riferimento alla traccia del segnale?<\/strong> <p class=\"schema-faq-answer\">Per massimizzare l'accoppiamento e ridurre al minimo l'induttanza del circuito, lo spessore del dielettrico tra la traccia di segnale e il relativo piano di riferimento dovrebbe essere il pi\u00f9 ridotto possibile, pur mantenendo l'affidabilit\u00e0 di produzione e rispettando i vincoli relativi alla larghezza della traccia. Nelle moderne configurazioni ad alta velocit\u00e0, tale distanza \u00e8 in genere compresa tra 3 e 5 mil. Un accoppiamento pi\u00f9 stretto riduce drasticamente il crosstalk e la radiazione elettromagnetica.<\/p> <\/div> <\/div>","protected":false},"excerpt":{"rendered":"<p>Nel campo della progettazione avanzata dei circuiti stampati (PCB), gli ingegneri spesso si concentrano in modo particolare sul tracciamento delle piste di segnale, regolandone meticolosamente le lunghezze, adattando le impedenze e tracciando le coppie differenziali con estrema precisione. Tuttavia, una pista di segnale rappresenta solo met\u00e0 dell\u2019equazione elettrica. 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